[发明专利]基于需求的纠错有效
申请号: | 200710085299.5 | 申请日: | 2007-02-27 |
公开(公告)号: | CN101187886A | 公开(公告)日: | 2008-05-28 |
发明(设计)人: | M·屈雷施;P·拉库纳斯;S·穆克赫吉 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G06F11/10 | 分类号: | G06F11/10;G06F12/08 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 曾祥夌;刘红 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | |||
搜索关键词: | 基于 需求 纠错 | ||
1.一种设备,包括:
多个高速缓存线;
多个纠错码(ECC)存储区,所述多个ECC存储区小于高速缓存线的数量。
2.如权利要求1所述的设备,其中,ECC存储区的数量等于已修改高速缓存线的最大数量。
3.如权利要求1所述的设备,其中,所述多个高速缓存线包括表明相应高速缓存线所对应的相应ECC存储区的标识(ID)字段。
4.如权利要求3所述的设备,其中,所述多个高速缓存线包括表明所述相应高速缓存线是否包含已修改数据的已修改字段(MOD)。
5.如权利要求2所述的设备,其中,所述已修改高速缓存线的最大数量为二。
6.如权利要求5所述的设备,其中,所述高速缓存线位于将要采用回写相干性策略的组关联高速缓存中。
7.如权利要求6所述的设备,其中,不处于已修改状态的所述高速缓存线将对应于许多检错码(EDC)存储区之一而不是ECC存储区。
8.如权利要求1所述的设备,其中,所述高速缓存线位于第1级高速缓冲存储器中。
9.一种系统,包括:
存储器;
处理器,耦合到所述存储器,把数据写入多个高速缓存线,所述高速缓存线存储少于或等于最大数量的已修改数据,所述最大已修改数据小于所述多个高速缓存线。
10.如权利要求9所述的系统,其中,所述已修改数据的最大数量的每个对应于纠错码(ECC)字段的最大数量。
11.如权利要求10所述的系统,其中,所述多个高速缓存线包括表明相应高速缓存线所对应的相应ECC字段的标识(ID)字段。
12.如权利要求11所述的系统,其中,所述已修改高速缓存数据的最大数量为二。
13.如权利要求12所述的系统,其中,所述多个高速缓存线位于将要采用回写相干性策略的组关联高速缓存中。
14.如权利要求13所述的系统,其中,不处于已修改状态的所述高速缓存线将对应于许多检错码(EDC)存储区之一而不是ECC存储区。
15.如权利要求9所述的系统,其中,如果所述处理器尝试把数据写入所述多个高速缓存线,并且已修改数据的数量等于所述已修改数据的最大数量,则所述已修改数据中的数据将被写入所述存储器。
16.如权利要求15所述的系统,其中,所述多个高速缓存线位于第1级(L1)高速缓冲存储器中。
17.如权利要求15所述的系统,其中,所述多个高速缓存线位于第2级(L2)高速缓冲存储器中。
18.一种方法,包括:
向高速缓存线阵列发出写操作;
在所述高速缓存线阵列包含最大数量的已修改高速缓存线时把已修改数据回写到存储器,已修改高速缓存线的所述最大数量少于所述高速缓存线阵列中的全部所述高速缓存线;
把所述数据写入清理高速缓存线,对应于所述已修改数据。
19.如权利要求18所述的方法,还包括把所述清理高速缓存线中的标识(ID)字段更新为指向纠错码(ECC)字段,其中ECC字段的最大数量等于所述已修改高速缓存线的最大数量。
20.如权利要求19所述的方法,如果读取所述高速缓存线数据,则针对检错码(EDC)对高速缓存线数据执行奇偶校验而不执行纠错。
21.如权利要求20所述的方法,其中,所述ECC字段的最大数量动态分配给所述高速缓存线阵列中的高速缓存线。
22.如权利要求21所述的方法,其中,所述已修改高速缓存线的最大数量为二。
23.如权利要求22所述的方法,其中,所述高速缓存线阵列包含在组关联高速缓存中。
24.如权利要求23所述的方法,其中,所述组关联高速缓存包括四路。
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