[发明专利]用于防止纹波的输入/输出端有效
申请号: | 201510638910.7 | 申请日: | 2015-09-29 |
公开(公告)号: | CN105470241B | 公开(公告)日: | 2018-07-10 |
发明(设计)人: | Y·A·阿特萨尔;T·考库格鲁 | 申请(专利权)人: | 亚德诺半导体集团 |
主分类号: | H01L23/58 | 分类号: | H01L23/58 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 刘倜 |
地址: | 百慕大群岛(*** | 国省代码: | 百慕大群岛;BM |
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摘要: | |||
搜索关键词: | 终端电路 串扰 输入输出路径 输入/输出端 相邻键合线 静电放电 输出路径 数字输入 耦合 低阻抗 并联 射频 纹波 串联 电路 输出 配置 | ||
1.一种电子器件,包括:
管芯,包括:
电连接到所述管芯的第一键合焊盘的射频(RF)输入/输出路径,
电连接到所述管芯的第二键合焊盘的第二输入/输出路径,
被配置来在第二输入/输出路径上提供静电放电保护的静电放电保护电路,以及
终端电路,电连接到所述管芯的所述第二键合焊盘,并与所述静电放电保护电路并联连接使得所述第二输入/输出路径被阻尼,
其中所述射频输入/输出路径被配置来处理射频信号,并且所述第二输入/输出路径被配置来处理第二信号,所述第二信号是非射频信号;
第一键合线,电连接到所述管芯的所述第一键合焊盘;和
第二键合线,电连接到所述管芯的所述第二键合焊盘;
其中,所述终端电路包括低阻抗损耗路径,并被配置来减轻由于所述第一键合线和所述第二键合线之间的耦合导致的串扰的影响,
所述低阻抗损耗路径包括串联RC电路,其中所述串联RC电路的电容器的电容和电阻器的电阻被选择为使得所述终端电路在所述射频信号的频率提供终止。
2.如权利要求1所述的电子器件,其中其中所述串联RC电路的电容器的电容被选择为使得其大于所述静电放电保护电路的有效电容。
3.如权利要求1所述的电子器件,其中所述第二输入/输出路径是数字输入/输出路径,并且所述第二信号是数字信号。
4.如权利要求1所述的电子器件,其中所述终端电路被配置来阻止电连接到所述第二键合焊盘的所述管芯上的负载由于所述串扰而谐振。
5.如权利要求1所述的电子器件,还包括包封所述管芯、所述第一键合线和所述第二键合线的封装,其中所述封装包括第一引脚,并且所述第一键合线电连接到所述第一引脚。
6.如权利要求1所述的电子器件,其中所述管芯至少包括衰减器、开关和移相器中的一个。
7.一种装置,包括:
第一输入/输出路径,电连接到管芯的第一触点,所述第一输入/输出路径被配置来传递射频信号;
第二输入/输出路径,电连接到所述管芯的第二触点,所述第二输入/输出路径被配置来传递第二信号,其中所述第二信号是非射频信号,并且其中在所述第一输入/输出路径和所述第二输入/输出路径之间存在串扰;和
静电放电保护电路,被配置来在第二输入/输出路径上提供静电放电保护;以及
低阻抗RC电路,电连接在所述管芯的所述第二触点和参考电位之间使得所述第二输入/输出路径被阻尼,所述低阻抗RC电路包括串联RC电路,其中所述串联RC电路的电容器的电容和电阻器的电阻被选择为使得所述低阻抗RC电路在所述射频信号的频率提供终止。
8.如权利要求7所述的装置,其中所述第二信号是数字信号。
9.如权利要求7所述的装置,还包括电连接到所述管芯的所述第一触点的第一键合线和电连接到所述管芯的所述第二触点的第二键合线,其中所述第一输入/输出路径被配置来通过所述第一键合线与所述第二键合线之间耦合的方式与所述第二输入/输出路径耦合。
10.如权利要求7所述的装置,其中所述RC电路被配置来阻止电连接到所述第二输入/输出路径的所述管芯的负载的有效电容由于所述第一输入/输出路径和所述第二输入/输出路径之间的串扰而谐振。
11.如权利要求10所述的装置,其中所述负载包括静电放电保护电路和输入/输出缓冲器。
12.如权利要求10所述的装置,其中所述串扰是由于在所述管芯之外的耦合。
13.如权利要求7所述的装置,其中所述参考电位是接地。
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