[发明专利]多晶粒的多核计算机平台及其开机方法有效
申请号: | 201910976748.8 | 申请日: | 2019-10-15 |
公开(公告)号: | CN110716756B | 公开(公告)日: | 2023-03-14 |
发明(设计)人: | 刘景龙;冯群超;牛彦奎;宋永峰;王金涛;王江波 | 申请(专利权)人: | 上海兆芯集成电路有限公司 |
主分类号: | G06F9/4401 | 分类号: | G06F9/4401;G06F9/445 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 李芳华 |
地址: | 上海市张江高科技*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | 多晶 多核 计算机 平台 及其 开机 方法 | ||
1.一种多晶粒多核计算机平台,包括:
第一储存器,储存编号0固件码以及编号1固件码;
主晶粒,经第一总线耦接该第一储存器;以及
第一从属晶粒,经该第一总线耦接该第一储存器,并且经由连结耦接该主晶粒,
其中:
该第一从属晶粒经该第一总线自该第一储存器载下该编号1固件码后,释出该第一总线的使用权,并输出编号0致能信号至该主晶粒,由该主晶粒获得该第一总线的使用权;
经该第一总线,该主晶粒自该第一储存器载下该编号0固件码;且
该第一从属晶粒执行该编号1固件码并且该主晶粒执行该编号0固件码以初始化该连结。
2.如权利要求1所述的多晶粒多核计算机平台,其中:
该主晶粒更包括编号0处理单元以及编号0芯片组,该第一从属晶粒更包括编号1处理单元以及编号1芯片组,该编号0处理单元为启动捆绑处理器,该编号1处理单元为应用处理器。
3.如权利要求2所述的多晶粒多核计算机平台,其中:
该编号1芯片组及该编号0芯片组分别获得该第一总线的使用权后分别自该第一储存器载下该编号1固件码及该编号0固件码,以分别供该编号1处理单元及该编号0处理单元执行,其中该编号1处理单元对该编号1固件码的执行,不受限于该编号1芯片组是否拥有该第一总线的使用权。
4.如权利要求1所述的多晶粒多核计算机平台,其中:
该第一从属晶粒更包括编号1总线控制器,操作该第一从属晶粒耦接该第一总线的一脚位为高阻抗,使该第一总线的使用权释出。
5.如权利要求1所述的多晶粒多核计算机平台,其中:
该第一从属晶粒更包括高速缓冲存储器:且
该第一从属晶粒将该编号1固件码高速缓存于该高速缓冲存储器,使该第一从属晶粒对该编号1固件码的执行,不受限于该第一从属晶粒是否拥有该第一总线的使用权。
6.如权利要求1所述的多晶粒多核计算机平台,其中:
该主晶粒更包括编号0芯片组,该编号0芯片组是在接收到该编号0致能信号后方启动。
7.如权利要求1所述的多晶粒多核计算机平台,其中:
该主晶粒更包括编号0芯片组,该编号0芯片组包括编号0总线控制器以及编号0寄存器;
已启动的该编号0总线控制器是根据该编号0寄存器的设定而获得该第一总线的使用权;且
该编号0寄存器是随该编号0致能信号设定。
8.如权利要求1所述的多晶粒多核计算机平台,更包括:
第二从属晶粒,经该第一总线耦接该第一储存器;以及
第三从属晶粒,经该第一总线耦接该第一储存器,
其中:
该第一储存器更储存编号2固件码以及编号3固件码;
该第三从属晶粒经该第一总线自该第一储存器载下该编号3固件码后,释出该第一总线的使用权,并输出编号2致能信号至该第二从属晶粒,由该第二从属晶粒获得该第一总线的使用权;
该第二从属晶粒经该第一总线自该第一储存器载下该编号2固件码后,释出该第一总线的使用权,并输出编号1致能信号至该第一从属晶粒,由该第一从属晶粒获得该第一总线的使用权。
9.如权利要求8所述的多晶粒多核计算机平台,其中:
该第三从属晶粒执行该编号3固件码、该第二从属晶粒执行该编号2固件码、该第一从属晶粒执行该编号1固件码、且该主晶粒执行该编号0固件码,以初始化该第三从属晶粒、该第二从属晶粒、该第一从属晶粒以及该主晶粒两两之间的连结;且
所述连结初始化完成后,该主晶粒更执行该编号0固件码主导该多晶粒多核计算机平台的初始化,并加载操作系统。
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