[发明专利]报文散列方法、装置、FPGA模组及处理器模组有效
申请号: | 201911352368.3 | 申请日: | 2019-12-24 |
公开(公告)号: | CN111131078B | 公开(公告)日: | 2022-09-16 |
发明(设计)人: | 张阿珍;张芦韦 | 申请(专利权)人: | 北京天融信网络安全技术有限公司;北京天融信科技有限公司;北京天融信软件有限公司 |
主分类号: | H04L49/90 | 分类号: | H04L49/90;H04L47/50;H04L69/22 |
代理公司: | 北京超凡宏宇专利代理事务所(特殊普通合伙) 11463 | 代理人: | 蒋姗 |
地址: | 100000 北京*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 报文 方法 装置 fpga 模组 处理器 | ||
1.一种报文散列方法,其特征在于,应用于现场可编程门阵列FPGA,在所述FPGA内包括多个散列队列,所述方法包括:
获取待发送报文,并解析所述待发送报文的协议类型;
根据所述协议类型查询预设的表项,确定与所述协议类型对应的预设运算次数,所述表项记录有与各种协议类型的报文对应的运算次数;
将所述待发送报文运算所述预设运算次数后,确定出与运算结果对应的散列队列;
将所述待发送报文散列到所述对应的散列队列。
2.根据权利要求1所述的方法,其特征在于,所述FPGA包括多个散列计算单元,每个散列计算单元内保存所述表项,在所述将所述待发送报文运算所述预设运算次数之前,所述方法还包括:
将所述待发送报文分配到一个处于空闲状态的散列计算单元;
相应的,所述将所述待发送报文运算所述预设运算次数后,确定出与运算结果对应的散列队列,包括:
通过所述处于空闲状态的散列计算单元将所述待发送报文运算所述预设运算次数后,确定出与运算结果对应的散列队列。
3.根据权利要求2所述的方法,其特征在于,所述多个散列计算单元并行工作,在所述将所述待发送报文分配到一个处于空闲状态的散列计算单元之前,所述方法还包括:
根据所述待发送报文的获取顺序,依次为每个所述待发送报文设置报文ID,所述报文ID的数值逐次增大;
相应的,所述将所述待发送报文散列到所述对应的散列队列,包括:
等待预设时长;
将所述预设时长内获取到的所述待发送报文按照其报文ID从小到大的顺序依次散列到各自对应的散列队列。
4.根据权利要求1所述的方法,其特征在于,所述FPGA与CPU网络通信,所述方法还包括:
通过所述对应的散列队列将所述待发送报文发送到所述CPU。
5.根据权利要求4所述的方法,其特征在于,所述CPU包括多个处理核,所述散列队列的个数与所述处理核的数量相同,且所述散列队列与所述处理核一一对应,所述通过所述对应的散列队列将所述待发送报文发送到所述CPU,包括:
通过所述对应的散列队列将所述待发送报文发送到所述CPU中与所述对应的散列队列对应的处理核。
6.根据权利要求4所述的方法,其特征在于,在所述FPGA内设置有FPGA指针,在所述CPU内设置有CPU指针,所述FPGA指针的初始值与所述CPU指针的初始值均为预设值,在所述获取待发送报文之后,所述方法还包括:
每获取到一个所述待发送报文,将所述FPGA指针的当前数值减一,同时回写描述符DD位;
相应的,所述通过所述对应的散列队列将所述待发送报文发送到所述CPU,包括:
在确定所述FPGA指针的当前数值与所述CPU指针的当前数值不相等时,通过所述对应的散列队列将所述待发送报文发送到所述CPU。
7.一种报文散列装置,其特征在于,应用于现场可编程门阵列FPGA,在所述FPGA内包括多个散列队列,所述装置包括:
获取模块,用于获取待发送报文,并解析所述待发送报文的协议类型;
控制模块,用于根据所述协议类型查询预设的表项,确定与所述协议类型对应的预设运算次数,所述表项记录有与各种协议类型的报文对应的运算次数;
运算模块,用于将所述待发送报文运算所述预设运算次数后,确定出与运算结果对应的散列队列;
散列模块,用于将所述待发送报文散列到所述对应的散列队列。
8.一种FPGA模组,其特征在于,包括片外闪存、存储器和处理器,所述存储器和所述处理器连接,所述处理器与所述片外闪存连接;
所述片外闪存用于存储程序;
所述存储器用于存储报文;
所述处理器加载存储于所述片外闪存中的程序,以执行如权利要求1-6中任一项所述的方法。
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