[发明专利]具有可配置逻辑外围设备的微控制器在审
申请号: | 201980097558.7 | 申请日: | 2019-12-17 |
公开(公告)号: | CN114026552A | 公开(公告)日: | 2022-02-08 |
发明(设计)人: | R·福丝 | 申请(专利权)人: | 微芯片技术股份有限公司 |
主分类号: | G06F15/78 | 分类号: | G06F15/78 |
代理公司: | 上海专利商标事务所有限公司 31100 | 代理人: | 蔡悦 |
地址: | 美国亚*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 具有 配置 逻辑 外围设备 控制器 | ||
1.一种微控制器,所述微控制器包括:
中央处理单元;
存储器;
I/O端口;以及
多个外围单元;
其中:
所述外围单元中的一者是可配置逻辑单元;
所述可配置逻辑单元由查找表形成,所述查找表由多个存储器单元形成,所述多个存储器单元接收预定数量的可从由所述外围单元提供的内部信号以及由至少一个外部引脚提供的至少一个外部信号中选择的输入地址信号并且生成输出信号;并且
所述中央处理单元被配置成直接为所述查找表提供输入地址信号。
2.根据权利要求1所述的微控制器,其中:
所述可配置逻辑单元包括:
输入多路复用器电路,所述输入多路复用器电路被配置成从所述内部信号和所述至少一个外部信号中选择所述预定数量的输入地址信号;以及
特殊功能输入寄存器,所述特殊功能输入寄存器耦接在所述输入多路复用器电路的输出和所述查找表的地址输入之间;
所述特殊功能输入寄存器被配置成接收和缓存所选择的输入信号;以及
所述中央处理单元被配置成从所述特殊功能输入寄存器读取以及写入所述特殊功能输入寄存器。
3.根据权利要求2所述的微控制器,其中所述特殊功能寄存器被存储器映射到数据存储器。
4.根据权利要求2至3中任一项所述的微控制器,其中:
所述可配置逻辑单元包括:
输入多路复用器电路,所述输入多路复用器电路被配置成从所述内部信号和所述至少一个外部信号中选择所述预定数量的输入信号;以及
另一个特殊功能输入寄存器,所述另一个特殊功能输入寄存器与所述输入多路复用器电路的输入耦接;并且
所述中央处理单元被配置成从所述另一个特殊功能输入寄存器读取以及写入所述另一个特殊功能输入寄存器以直接向所述查找表提供输入信号。
5.根据权利要求4所述的微控制器,其中所述另一个特殊功能寄存器被存储器映射到数据存储器。
6.根据权利要求2至3中任一项所述的微控制器,其中所述查找表包括多个1位存储器单元。
7.根据权利要求6所述的微控制器,其中所述多个1位存储器单元被存储器映射到所述数据存储器。
8.根据权利要求6所述的微控制器,其中所述多个1位存储器单元被存储器映射到程序存储器。
9.根据权利要求8所述的微控制器,其中所述程序存储器是闪存存储器。
10.根据权利要求6至9中任一项所述的微控制器,还包括直接存储器访问控制器,所述直接存储器访问控制器被配置成能够将数据传输到所述多个1位存储器单元中。
11.根据权利要求6至10中任一项所述的微控制器,还包括多路复用器,所述多路复用器具有与所述多个1位存储器单元耦接的多个输入,其中所述多路复用器被控制以选择与所述输入地址信号相对应的所述存储器单元中的一者的输出。
12.根据权利要求6至11中任一项所述的微控制器,还包括地址解码器,所述地址解码器被配置成选择与在所述地址解码器处接收的输入地址信号相对应的所述存储器单元中的一者。
13.根据权利要求1至12中任一项所述的微控制器,还包括逻辑电路,所述逻辑电路与所述查找表的输出耦接。
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