[发明专利]信息处理方法、信息处理装置和电子设备在审
申请号: | 202011403656.X | 申请日: | 2020-12-02 |
公开(公告)号: | CN112416437A | 公开(公告)日: | 2021-02-26 |
发明(设计)人: | 胡世文 | 申请(专利权)人: | 海光信息技术股份有限公司 |
主分类号: | G06F9/38 | 分类号: | G06F9/38;G06F12/08 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 彭久云 |
地址: | 300392 天津市华苑产业区*** | 国省代码: | 天津;12 |
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摘要: | |||
搜索关键词: | 信息处理 方法 装置 电子设备 | ||
一种信息处理方法、信息处理装置、电子设备。该信息处理方法包括:获取历史读取请求的读取信息,历史读取请求指示在历史时刻处理器核请求读取的第一存储信息,读取信息包括第一存储信息的历史虚拟地址和历史物理地址;根据历史虚拟地址,预测处理器核在未来时刻请求读取的第二存储信息所在的预测虚拟地址;判断预测虚拟地址与历史虚拟地址是否在同一个虚拟地址页中;响应于预测虚拟地址与历史虚拟地址在同一个虚拟地址页中,根据历史虚拟地址、历史物理地址和预测虚拟地址确定第一预测物理地址;以及将第一预测物理地址中存储的第二存储信息缓存到处理器的第一级缓存。该信息处理方法可以提高预先提取信息的时效性。
技术领域
本公开的实施例涉及一种信息处理方法、信息处理装置和电子设备。
背景技术
指令数据预取是提升高性能中央处理单元(CPU)的性能的关键技术之一。缓存只能保存CPU核最近访问过的数据。当读取从未被访问的数据或是由于缓存大小限制被踢出的数据时,CPU核仍然需要等待数十甚至上百个时钟周期,造成性能损失。指令与数据预取能够根据数据访问规律来提前预取即将被使用的数据,从而减少CPU核等待数据的时钟周期,并提升CPU整体性能。
发明内容
本公开至少一个实施例提供一种信息处理方法,包括:获取历史读取请求的读取信息,历史读取请求由处理器的处理器核发送,历史读取请求指示在历史时刻处理器核请求读取第一存储信息,读取信息包括第一存储信息的历史虚拟地址和历史物理地址,历史物理地址与历史虚拟地址相对应;根据历史虚拟地址,预测处理器核在未来时刻请求读取的第二存储信息所在的预测虚拟地址;判断预测虚拟地址与历史虚拟地址是否在同一个虚拟地址页中;响应于预测虚拟地址与历史虚拟地址在同一个虚拟地址页中,根据历史虚拟地址、历史物理地址和预测虚拟地址确定第一预测物理地址,第一预测物理地址与预测虚拟地址相对应;以及将第一预测物理地址中存储的第二存储信息缓存到处理器的第一级缓存,处理器包括多级缓存,第一级缓存为多级缓存中与处理器核电连接并且与处理器核直接传输数据的缓存。
例如,在本公开一实施例提供的信息处理方法中,响应于预测虚拟地址与历史虚拟地址在同一个虚拟地址页中,根据历史虚拟地址、历史物理地址和预测虚拟地址确定第一预测物理地址,包括:响应于预测虚拟地址与历史虚拟地址在同一个虚拟地址页中,将预测虚拟地址与历史虚拟地址之间的偏移量与历史物理地址的和作为第一预测物理地址。
例如,在本公开一实施例提供的信息处理方法中,多级缓存至少还包括第二级缓存,第二级缓存为与第一级缓存电连接并且通过第一级缓存与处理器核传输数据的缓存,第一级缓存存储第一级存储信息,第二级缓存存储第二级存储信息,第二级存储信息至少包括第一级存储信息,第二级缓存中还包括状态信息,状态信息指示第二级存储信息是否位于第一级缓存中,第二存储信息位于多级缓存中或者内存中。
例如,在本公开一实施例提供的信息处理方法中,处理器还包括第一级缓存预取器和地址缓存,将第一预测物理地址中存储的第二存储信息缓存到处理器的第一级缓存,包括:第一级缓存预取器根据第一预测物理地址生成第一预取请求,并且发送第一预取请求以使第一预取请求到达地址缓存;地址缓存向第二级缓存发送第一预取请求;第二级缓存响应于第一预取请求,确定第一级缓存中是否已经缓存了第一预测物理地址对应的第二存储信息;响应于第一级缓存已经缓存了第一预测物理地址对应的第二存储信息,第二级缓存通知地址缓存丢弃第一预取请求;响应于第一级缓存未缓存第一预测物理地址对应的第二存储信息,第二级缓存提取第一预测物理地址对应的第二存储信息,并且向地址缓存发送提取的第二存储信息,使得地址缓存向第一级缓存发送提取的第二存储信息以使第二存储信息缓存在第一级缓存中。
例如,在本公开一实施例提供的信息处理方法中,第一级缓存预取器根据第一预测物理地址生成第一预取请求,并且发送第一预取请求以使第一预取请求到达地址缓存,包括:第一级缓存预取器向预取队列发送第一预取请求,以通过预取队列存储第一预取请求;以及响应于地址缓存存在空闲空间,预取队列向地址缓存发送第一预取请求。
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