[发明专利]电子管芯制造方法在审
申请号: | 202210836125.2 | 申请日: | 2022-07-15 |
公开(公告)号: | CN115700905A | 公开(公告)日: | 2023-02-07 |
发明(设计)人: | O·奥里;P·拉比耶 | 申请(专利权)人: | 意法半导体(图尔)公司 |
主分类号: | H01L21/78 | 分类号: | H01L21/78;H01L21/683;G01R31/26;G01R31/28 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 董莘 |
地址: | 法国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 电子 管芯 制造 方法 | ||
本发明涉及一种电子管芯制造方法,包括:a)在半导体衬底的第一表面侧上沉积电绝缘树脂层,电绝缘树脂层的内部和顶部已经预先形成了多个集成电路,半导体衬底在与第一表面相对的第二表面上支撑接触焊盘;以及b)在半导体衬底的第二表面侧上形成第一沟槽,该第一沟槽将集成电路彼此电隔离,第一沟槽在半导体衬底中垂直延伸并伸出到树脂层中或在树脂层的顶部。
本申请要求于2021年7月16日提交的名为“电子管芯制造方法(ELECTRONIC DIEMANUFACTURING METHOD)”的法国专利申请号为FR2107694的优先权,在法律允许的最大范围内通过引用将该专利申请合并于此。
技术领域
本公开总体上涉及半导体电子管芯的制造。
背景技术
通常,一种制造电子管芯的方法可以包括最后的电测试步骤,在此期间,借助于电连接到电子测试设备的金属测试垫,将电测试信号施加到管芯连接金属层。
希望至少部分地改进已知的电子管芯制造方法的某些方面。
发明内容
一个实施例提供了一种电子管芯制造方法,包括:
步骤a),在半导体衬底的第一表面侧上沉积电绝缘树脂层,电绝缘树脂层的内部和顶部已经预先形成了多个集成电路,半导体衬底在与第一表面相对的第二表面上支撑接触焊盘;以及
步骤b),在半导体衬底的第二表面侧上形成第一沟槽,将集成电路彼此电隔离,第一沟槽在半导体衬底中垂直延伸并进入到树脂层中或树脂层的顶部。
根据一个实施例,步骤b)之后是电子管芯的单个化(individualization)的步骤c)。
根据一个实施例,通过在第一沟槽中形成第二沟槽来实现步骤c)中的单个化。
根据一个实施例,通过减薄绝缘树脂层来实现步骤c)中的单个化。
根据一个实施例,该方法在步骤b)和c)之间包括对集成电路进行电测试的步骤d)。
根据一个实施例,第一沟槽延伸穿过衬底的整个厚度。
根据一个实施例,该方法包括在步骤a)和步骤b)之间形成第三沟槽的步骤,该第三沟槽在集成电路之间从半导体衬底的第一表面横跨半导体衬底的一部分厚度延伸。
根据一实施例,第三沟槽在半导体衬底中向下延伸到半导体衬底的厚度的30%至75%范围内的深度。
根据一个实施例,第三沟槽的宽度大于第一沟槽的宽度。
根据一个实施例,在步骤a)期间,半导体衬底的厚度在50μm至500μm的范围内,优选50μm至130μm。
附图说明
上述特征和优点以及其他将在以下参照附图以说明而不是限制的方式给出的特定实施例的描述中详细描述,其中:
图1以截面图示出了根据第一实施例的电子管芯制造方法的示例的步骤;
图2以截面图示出了根据第一实施例的电子管芯制造方法的示例的另一步骤;
图3以截面图示出了根据第一实施例的电子管芯制造方法的示例的另一步骤;
图4以截面图示出了根据第一实施例的电子管芯制造方法的示例的另一步骤;
图5以截面图示出了根据第一实施例的电子管芯制造方法的示例的另一步骤;
图6以截面图示出了根据第一实施例的电子管芯制造方法的示例的另一步骤;
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于意法半导体(图尔)公司,未经意法半导体(图尔)公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造