[发明专利]一种分组信息传送方法无效
申请号: | 87104848.5 | 申请日: | 1987-07-13 |
公开(公告)号: | CN1015855B | 公开(公告)日: | 1992-03-11 |
发明(设计)人: | 唐启山 | 申请(专利权)人: | 电子工业部第七研究所 |
主分类号: | H04K1/00 | 分类号: | H04K1/00;H03M7/00 |
代理公司: | 广东专利事务所 | 代理人: | 朱丽华 |
地址: | 广东省广州*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 一种 分组 信息 传送 方法 | ||
本发明提供一种分组信息传送方法,适用于跳频、猝发和保密等通信系统。
现有的传送方法中,分组信息的帧同步码、目的地址、同步数据等都是分区段传送的。参见图1。图中,1为帧同步码区段,2为目的地址区段,3为数据区段。工作过程中,为确保检测概率足够高,虚警概率足够小,帧同步码的位数不能大;而为确保在误码率大时(如10-1)能使地址和数据的正确接收概率足够高,又必须对它们进行冗余编码,这造成效率下降。
本发明的目的在于避免现有技术中的不足之处而提供一种传送方法,不需要专门的帧同步码区段和目的地址区段;而且在数据比特数据及正确接收概率和现有方法相等时,所需要的冗余度将不大于现有的方法。也就是说本发明只需要原来数据段的比特长度,就能够以相同的正确接收概率传送同样的分组信息。
本发明的编码方法是这样的:将需要传送的K比特数据,编码为(L,K)分组纠错码(L为编码长度,K为信息位数)。设M=NL为正整数。对(L,K)码中的任一比特长度ai(I≤i≤L)代之以序列bi=aiCi式中Ci为N个比特序列,共有2N种。考虑到ai可取0或1,使用Ci之后就不能再使用它的反序列Ci,因此可用序列为2N-1。此L个b序列(I≤i≤L)按一定的规律加以位置扰乱。如(L,K)码的某一位所对应的N比特序列,可在M位数据段的第5.9.13......等位传送,余类推。扰乱方法共有M!种。
经上述处理所得到的M比特,再与另一自相关和互相关性能优良的M位序列逐位进行模二加运算后向收端传送,设满足要求的M位相关序列共有H种。
这样编码方式的地址总量为2(N-1)L*M!*H种。拥有的地址量是巨大的。
收端已知发端采用的N位序列,M位相关序列和位置扰乱方式,a是随机数据,它可能取0或1,故发端传送的可能是C或C的出现次数G,接收到M位同步序列后,只要和已知的M位相关序列再进行模二加,然后在各个所知的位检测C或C的出现次数G。当G超过门限值,则加以接受,获得帧同步。经大数逻辑译码和纠错译码后即可得到发端的数据。
按照给定的误码率、检测和虚警概率,适当地选择N、L、G即可满足通信系统要求。
图1是现有的分组传送方法。图2是发端编码图,它包括数据入1,编码器9,序列发生器2,地址存贮器7,相关序列发生器3,移位寄存器4,开关阵列6模二加法器5和输出到接收端序列8。图3是收端方块图,它是由发送序列1,模二加法器2相关序列3,地址码存贮器12,移位寄存器4,开关阵列5,相关器6,计数器7,大数逻辑译码器8,纠错译码器9,帧同步脉冲形成器10,帧同步脉冲出11,数据出13组成。
下面结合图2说明发端编码过程。需要传送的K位数据I,在编码器9中编码为(L、K)码后,送入N位序列发生器2,按地址码存贮器的指令,分别输出Ci或Ci到开关阵列6。开关阵列6在地址码的控制下,将Ci或Ci存入M位移位寄存器4的相应位置,实现扰乱。相关序列发生器3,在地址码存贮器7的控制下产生相应的M位相关序列与4中的M序列在模二加法器5中进行模二加之后,拟发送到收端的序列为8。
图3为收端方块图。由发端来的序列1,在模二加法器2中与由地址码存贮器12控制下相关序列发生器3产生的M位相关序列进行模二加之后存入M位移位寄存器4。在地址码存贮器12控制下,开关阵列5分别选择各N位序列Ci或者Ci送到相关器6。相关器6在获得正相关或负相关判决之后,送一脉冲信号到计数器7,计数器7在计满G个脉冲之后,给帧同步脉冲形成器10一个高电平,使之产生帧同步脉冲11。同步脉冲11,启动大数逻辑译码8,进行大数逻辑译码,译码器输出再纠错译码器9中进行译码,获得数据13。
综上述,采用本发明的方法,仅用数据区段的码元长度,即可实现包括帧同步码、目的地址和数据在内的分组信息的传送和接收,效率高而且传输可靠,很有实用价值。
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