[发明专利]多用途纠错计算电路无效

专利信息
申请号: 95195981.6 申请日: 1995-09-15
公开(公告)号: CN1163684A 公开(公告)日: 1997-10-29
发明(设计)人: C·P·祖克 申请(专利权)人: 西尔拉斯逻辑公司
主分类号: H03M13/00 分类号: H03M13/00
代理公司: 中国专利代理(香港)有限公司 代理人: 王勇,邹光新
地址: 美国加利*** 国省代码: 暂无信息
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摘要:
搜索关键词: 多用途 纠错 计算 电路
【权利要求书】:

1.一种用于对表示包含在数据的纠错中的值的电信号执行运算的电路,该电路包括:

一个第一寄存器体;

连接在第一寄存器体中所选择的寄存器上的一个反馈乘法器,用于将第一寄存器体的内容乘以一个反馈乘数;

一个第二寄存器体;

一个内积电路,用于对第一寄存器体的内容与第二寄存器体的内容生成一个内积;

一个第三寄存器体;

一个加法器,用于利用至少由内积电路生成的内积与第三寄存器体的内容更新第二寄存器体的内容;

其中第二寄存器体与第三寄存器体中至少一个具有一个串行输入端,借此可将一个多位值串行加载到其中。

2.权利要求1的装置,其中该第二寄存器体具有一个串行输入端,借此能将一个多位值串行加载进第二寄存器体中,并且还包括一个第二寄存器体加载开关,用于连接第二寄存器体的串行输入端,从而可将多个串行多位值中所选择的一个加载进第二寄存器体中。

3.权利要求2的装置,其中该第二寄存器体加载开关为一个多路复用器。

4.权利要求2的装置,还包括:

一个第一多位存储寄存器;

一个第二多位存储寄存器;以及

其中该第二寄存器体加载开关是连接到包含一组第二寄存器体串行输入线的多条输入线上的,将该组第二寄存器体串行输入线中的第一条线连接在第一多位存储寄存器上,并将该组第二寄存器体串行输入线中的第二条线连接在第二存储寄存器上。

5.权利要求4的装置,其中第一多位存储寄存器与第二多位存储寄存器为串行移位寄存器。

6.权利要求4的装置,其中第一多位存储寄存器与第二多位存储寄存器中至少一个是有选择地连接成将来自第一寄存器体、第二寄存器体与第三寄存器体中至少一个的值加载在其中的。

7.权利要求6的装置,其中第二多位存储寄存器是有选择地连接成将来自至少第一寄存器体的值加载在其中的。

8.权利要求2的装置,其中可将一个常数值通过第二寄存器体加载开关串行加载进第二寄存器体中。

9.权利要求1的装置,其中第三寄存器体具有一个串行输入端,借此多位值能串行加载进第三寄存器体中,并且还包括一个第三寄存器体加载开关,用于连接第三寄存器体的串行输入端,从而能将多个串行多位值中所选择的一个加载进第三寄存器体中。

10.权利要求9的装置,其中该第三寄存器体加载开关为一个多路复用器。

11.权利要求9的装置,还包括:

一个第一多位存储寄存器;

一个第二多位存储寄存器;以及

其中该第三寄存器体加载开关连接在包含一组第三寄存器体串行输入线的多条输入线上,该组第三寄存器体串行输入线中的第一条线连接在第一多位存储寄存器上,及该组第三寄存器体串行输入线中的第三条线连接在第二存储寄存器上。

12.权利要求11的装置,其中第一多位存储寄存器与第二多位存储寄存器为串行移位寄存器。

13.权利要求12的装置,其中第一多位存储寄存器与第二多位存储寄存器中至少一个是双向可移位的串行移位寄存器。

14.权利要求12的装置,其中第一多位存储寄存器与第二多位存储寄存器中至少一个是有选择地连接成将来自第一寄存器体、第二寄存器体及第三寄存器体之一的值加载在其中的。

15.权利要求14的装置,其中第二多位存储寄存器是有选择地连接成将来自至少第一寄存器体的值加载在其中的。

16.权利要求9的装置,其中可将一个常数值通过第三寄存器体加载开关串行加载进第三寄存器体中。

17.权利要求9的装置,还包括一个用于第三寄存器体的反馈乘法器,它连接到第三寄存器体中选择的寄存器上用于将第三寄存器体的内容乘以一个反馈乘数。

18.权利要求9的装置,其中可将来自内积电路的一个输出信号通过第三寄存器体加载开关串行加载进第三寄存器体中。

19.权利要求9的装置,其中可将第三寄存器体的内容通过第三寄存器体加载开关串行加载进第三寄存器体。

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