[发明专利]数字式调制信号接收机无效
申请号: | 00123792.6 | 申请日: | 2000-09-07 |
公开(公告)号: | CN1148968C | 公开(公告)日: | 2004-05-05 |
发明(设计)人: | 川井智 | 申请(专利权)人: | 阿尔卑斯电气株式会社 |
主分类号: | H04N7/20 | 分类号: | H04N7/20;H04L27/227;H03L7/06 |
代理公司: | 北京三幸商标专利事务所 | 代理人: | 刘激扬 |
地址: | 日本国*** | 国省代码: | 日本;JP |
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摘要: | 本发明提供一种数字式调制信号接收机。其具有包括对数字式调制信号实施输入用的两个频率混合器的IQ解调制器,将其频率与数字式调制信号传送频率大体相等的本机振荡信号输入至频率混合器用的电压控制型本机振荡信号发生器,依据基频信号和本机振荡信号输出误差信号用的锁相环路回路,以及对误差信号实施平滑处理并将控制电压供给至本机振荡信号发生器用的低通滤波器,而且这种信号接收机可以改变基频信号频率。 | ||
搜索关键词: | 数字式 调制 信号 接收机 | ||
【主权项】:
1.一种数字式调制信号接收机,其特征在于具有包括对数字式调制信号实施输入用的两个频率混合器的IQ解调制器,将其频率与数字式调制信号传送频率大体相等的本机振荡信号输入至所述频率混合器用的电压控制型本机振荡信号发生器,依据基频信号和所述本机振荡信号输出误差信号用的锁相环路回路(PLL回路),以及对所述误差信号实施平滑处理并将控制电压供给至所述本机振荡信号发生器用的低通滤波器,将对所述数字式调制信号的频道实施特别指定用的频道数据输入至所述锁相环路回路(PLL回路)用的选择组件,所述选择组件将判断所述频道传送速率是高于所述预定传送速率还是低于所述预定传送速率用的判断用数据,与所述频道数据一并实施输出,所述锁相环路回路(PLL回路)具有依据所述判断用数据输出双值信号用的频道译码器,而且这种数字式调制信号接收机可以对所述基频信号频率实施改变,从而对于所述数字式调制信号的传送速率比预定传送速率低的场合,可以使所述基频信号频率高于预定频率,而对于所述数字式调制信号的传送速率比所述预定传送速率高的场合,又可以使所述基频信号频率低于所述预定频率。
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