[发明专利]双环路锁相环无效
| 申请号： | 00132919.7 | 申请日： | 2000-09-17 |
| 公开（公告）号： | CN1291002A | 公开（公告）日： | 2001-04-11 |
| 发明（设计）人： | S·哈法姆 | 申请（专利权）人： | 索尼英国有限公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/22;H04B1/40 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 陈景峻 |
| 地址： | 英国*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明涉及适合于集成在一块硅单片集成电路上的双环路锁相环(PLL)结构。该双环路锁相环包括两个PLL1,3a、13b。来自第一个PLL13a的输出信号供给安排在第二个PLL的反馈环路之中且在初始分频器20b之后的混频器24。这减少了装置的功率消耗,因为由于在初始分频器20b中的分频,混频器24工作在较低频率。第二PLL13b锁相混频器24的输出到一个比较信号。来自第一PLL13a的输出信号通过一个中间分频器24提供给混频器24。这个混频器可以数字地实现,如一种D型触发器。 | ||
| 搜索关键词： | 环路 锁相环 | ||
【主权项】：
1．一个双环路锁相环，包括：第一锁相环，安排输出锁相到第一比较信号的第一输出信号；和第二锁相环，安排输出主输出信号和有用于反馈输出信号的一个反馈环路，该反馈环路包括至少一个初始分频器，其中一个混频器在安排在第二锁相环路的反馈环路中且在初始分频器之后的第一输入端接收第一输出信号，以便在第二输入端接收通过初始分频器反馈的主输出信号和输出一个混频信号给该反馈环路。
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