[发明专利]数模转换器无效
申请号: | 00816479.7 | 申请日: | 2000-11-22 |
公开(公告)号: | CN1402909A | 公开(公告)日: | 2003-03-12 |
发明(设计)人: | 户田彰彦;前岛利夫;野吕正夫 | 申请(专利权)人: | 雅马哈株式会社 |
主分类号: | H03M1/68 | 分类号: | H03M1/68;H03M1/76 |
代理公司: | 隆天国际专利商标代理有限公司 | 代理人: | 陈红,楼仙英 |
地址: | 日本国静*** | 国省代码: | 暂无信息 |
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摘要: | 本发明提供了一种电阻串D/A转换器,它能从转换的数据中获得具有更多比特的多比特数据而不使用更多的电阻。转换的数据的4个最高有效位加在解码器1,而数据的4个最低有效位经反相电路2加在解码器3。解码器1解码4个最高有效位,然后,根据解码结果导通FET的F0至FET15中的任何一个FET。结果,选择在串联电阻r0至r15串的各结点的一个电压加在运算放大器6。类似地,相应于4个最低有效位的电压加在运算放大器7。然后,运算放大器7的输出电压用电阻ra、rb减小到其1/16。己减小的电压加上加到运算放大器6的电压,从而获得相应于转换的数据的模拟电压。 | ||
搜索关键词: | 数模转换器 | ||
【主权项】:
1.一种数模转换器,包括:多个串联连接的电阻;第1至第m个选择装置,根据通过将转换的数据划分为以所述数据最高有效位到最低有效位的顺序连续排列的各组n个位获得的各第1至第m个数据,选择地输出所述多个电阻之间的各结点电压;和运算装置,将所述第2至第m个选择装置的输出电压减小为其1/2(m-1)n,然后将减小的电压加到所述第1选择装置输出的电压或从所述第1选择装置输出的电压减去减小的电压。
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