[发明专利]多存储库DIMM中实现的每个周期内的多重访问无效
| 申请号： | 01809630.1 | 申请日： | 2001-05-15 |
| 公开（公告）号： | CN1436331A | 公开（公告）日： | 2003-08-13 |
| 发明（设计）人： | 克里斯·卡拉巴茨奥斯 | 申请（专利权）人： | 克里斯·卡拉巴茨奥斯 |
| 主分类号： | G06F12/00 | 分类号： | G06F12/00 |
| 代理公司： | 中原信达知识产权代理有限责任公司 | 代理人： | 关兆辉,张天舒 |
| 地址： | 美国马萨*** | 国省代码： | 暂无信息 |
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| 摘要： | 本发明公开了一种计算机存储器系统，它能够提供双数据速率(DDR)存储器输出同时只需具有现有技术的DDR存储器芯片频率限制的一半频率的存储器芯片。该系统包括一个含有数据线106的第一存储器库101以及一个含有数据线107的第二存储器库102。一个基本系统时钟利用锁相环140或其它相移器件而产生一个延迟的时钟信号。第一存储器库的数据线与时钟信号104同步地和数据总线116相连，第二存储器库的数据线则与时钟信号105同步地和数据总线114相连。作为结果，数据总线不会同时与两个存储器库的数据线相连接，而是交替地与第一数据存储库和第二数据存储库连接。 | ||
| 搜索关键词： | 存储 dimm 实现 每个 周期 多重 访问 | ||
【主权项】：
1.一种具有数据总线的计算机存储器系统，包括：(a)含有数据线的第一列存储器库；(b)含有数据线的第二列存储器库；(c)含有多个周期的时钟信号，其中每个周期都含有一个起点并且具有一个周期p；(d)第一开关装置，用于在各个所述周期开始时将所述第一存储器库的数据线与数据总线连接起来，并且随后持续p/2时间；以及(e)第二开关装置，用于在各个所述周期开始后的p/2处将所述第二存储器库的数据线与数据总线连接起来，并且随后持续p/2时间。
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