[发明专利]并行计数器和用于执行乘法的逻辑电路无效
| 申请号： | 01816928.7 | 申请日： | 2001-07-27 |
| 公开（公告）号： | CN1468396A | 公开（公告）日： | 2004-01-14 |
| 发明（设计）人： | 德文特里·鲁梅宁;苏尼尔·塔瓦尔;彼得·默历曼斯 | 申请（专利权）人： | 自动平行设计公司 |
| 主分类号： | G06F7/60 | 分类号： | G06F7/60;G06F7/50;G06F7/52;G06F17/50 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 朱进桂 |
| 地址： | 英国*** | 国省代码： | 英国;GB |
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| 摘要： | 一种如并行计数器之类的逻辑电路，包括：用于产生用作输入位的初等对称函数的输出位。该并行计数器可以应用于乘法电路。也设置乘法电路，其中产生二进制数字的各位和另一二进制数字的各位的组合的、具有简化形式的阵列，以减少阵列简化所需要的步骤。 | ||
| 搜索关键词： | 并行 计数器 用于 执行 乘法 逻辑电路 | ||
【主权项】：
1.一种并行计数器，包括：多个输入端，用于接收二进制数字，作为多个二进制输入；多个输出端，用于输出表示多个二进制输入中的二进制输入的数字的二进制代码；逻辑电路，连接在多个输入端和多个二进制输出端之间，用于产生多个二进制输出的每个输出，作为二进制输入的初等对称函数。
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