[发明专利]使用综合用于有效数据加载和下载的基于分组的协议的逻辑的硬件辅助的设计验证系统无效
| 申请号： | 01820983.1 | 申请日： | 2001-10-19 |
| 公开（公告）号： | CN1543618A | 公开（公告）日： | 2004-11-03 |
| 发明（设计）人： | T·奥卡米 | 申请（专利权）人： | 快速转动设计系统公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 吴立明;王忠忠 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 提供增加用户的设计中的寄存器和存储器的可访问性的一个系统，该用户的设计经历在一个硬件辅助设计验证系统中的功能验证。使用一个基于分组的协议执行在一个主工作站和硬件加速器之间的数据传输操作，以便在逻辑模拟期间向在目标验证下设计(DUV)中的该寄存器和存储器加载数据和由其下载数据。该方法和设备综合接口逻辑到该DUV中以对在该目标DUV中的寄存器和存储器提供更多的访问，该DUV是在该硬件加速器的辅助之下进行模拟的。 | ||
| 搜索关键词： | 使用 综合 用于 有效 数据 加载 下载 基于 分组 协议 逻辑 硬件 辅助 设计 验证 系统 | ||
【主权项】：
1.一种为读和写而用于编辑一个用户的设计以允许对在该用户的设计中的存储器和寄存器更大量访问的方法，包括：识别在该用户的设计中的所有存储器和寄存器；综合可访问性逻辑于该用户的设计中，所说访问性逻辑产生对该存储器和寄存器的访问端口。
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