[发明专利]高速数据链路控制协议接收处理模块及其数据处理方法无效
申请号: | 02122994.5 | 申请日: | 2002-06-15 |
公开(公告)号: | CN1466347A | 公开(公告)日: | 2004-01-07 |
发明(设计)人: | 黄勇;张赞 | 申请(专利权)人: | 华为技术有限公司 |
主分类号: | H04L29/08 | 分类号: | H04L29/08 |
代理公司: | 暂无信息 | 代理人: | 暂无信息 |
地址: | 518057广东*** | 国省代码: | 广东;44 |
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摘要: | 本发明属于网络互连设备技术领域,涉及一种HDLC协议接收处理模块及其数据处理方法。其模块由一个端口仲裁模块、一个接收HDLC协议处理器和一个状态存储器模块所组成;其数据处理方法为:端口仲裁模块为N个端口共享数据处理流水线提供仲裁,并把需要处理的数据依据优先级别依次送给接收HDLC协议处理器;接收HDLC协议处理器把该数据所属的HDLC通道的状态数据从状态存储器模块读出,对数据进行流水线处理,并把该HDLC通道的新状态数据写回状态存储器。本发明使用一个并行HDLC协议接收处理器对所有端口的数据流进行处理,具有处理速度快,占用芯片的面积不会随端口的增多而线性增大,通用性强的优点。 | ||
搜索关键词: | 高速 数据链 控制 协议 接收 处理 模块 及其 数据处理 方法 | ||
【主权项】:
1、一种高速数据链路控制协议接收处理模块,其特征在于,由一个端口仲裁模块、一个接收高速数据链路控制协议处理器和一个状态存储器模块所组成;其中,所说的端口仲裁模块的输入端同时与N个端口相连接,所说的接收高速数据链路控制协议处理器的输入端与该端口仲裁模块输出端相连,同时与所说的状态存储器模块双向连接,该接收高速数据链路控制协议处理器的输出端与后面电路的先进先出缓冲器的输入端相连。
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