[发明专利]以金属硬遮罩层制作双镶嵌插销的方法有效
申请号: | 02126847.9 | 申请日: | 2002-07-19 |
公开(公告)号: | CN1419277A | 公开(公告)日: | 2003-05-21 |
发明(设计)人: | 蔡腾群;许嘉麟 | 申请(专利权)人: | 联华电子股份有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/28;H01L21/3205 |
代理公司: | 上海专利商标事务所 | 代理人: | 任永武 |
地址: | 台湾省新竹科学*** | 国省代码: | 台湾;71 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明有关一种制作双镶嵌(copperdualdamascene)插销(via)的方法,特别是有关一种以金属硬遮罩层(metalhardmasklayer)制作双镶嵌插销的方法。本发明利用一金属层作为硬遮罩层,以使插销形成之后,隔离层(isolationlayer)的表面可维持一平面而非一圆滑凸面,以防止插销相互连结而产生漏电流的缺陷。 | ||
搜索关键词: | 金属 硬遮罩层 制作 镶嵌 插销 方法 | ||
【主权项】:
1.一种制作一双镶嵌插销的方法,其特征在于,该方法至少包括:提供一晶片,该晶片包括一第一金属层;形成一覆盖层于该第一金属层上;形成一第一低介电常数介电层于该覆盖层上;形成一中间蚀刻停止层于该第一低介电常数介电层上;形成一第二低介电常数介电层于该中间蚀刻停止层上;形成一介电硬遮罩层于该第二低介电常数介电层上;形成一第二金属层于该介电硬遮罩层上;移除部分的该第二金属层以在部分的该介电硬遮罩层上形成一金属硬遮罩层;形成一光罩层于该第二金属层与部分的该介电硬遮罩层上;移除部分的该介电硬遮罩层与部分的该第二低介电常数介电层以在该介电硬遮罩层与该第二低介电常数介电层内形成一第一渠沟;移除该光罩层;移除部分的该介电硬遮罩层与该第一渠沟的一底部的该中间蚀刻停止层;移除部分的该第二低介电常数介电层以在该第二低介电常数介电层内形成一第二渠沟并移除部分的该第一低介电常数介电层以在该第一低介电常数介电层内形成一第三渠沟,其中该第二渠沟与该第三渠沟相互连接;移除该第三渠沟的一底部的该覆盖层,并移除该第二渠沟的部分的一底部的该中间蚀刻停止层;形成一第三金属层于该第二金属层上与该第二渠沟及该第三渠沟内,并填满该第二渠沟与该第三渠沟;及移除部分的该第三金属层以露出该第二金属层,并使该第三金属层与该第二金属层的一平面为一平坦的平面。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造