[发明专利]多位存储单元及其制造方法有效
申请号: | 02140506.9 | 申请日: | 2002-07-05 |
公开(公告)号: | CN1466193A | 公开(公告)日: | 2004-01-07 |
发明(设计)人: | 赖二琨 | 申请(专利权)人: | 旺宏电子股份有限公司 |
主分类号: | H01L21/8239 | 分类号: | H01L21/8239;H01L27/10 |
代理公司: | 隆天国际知识产权代理有限公司 | 代理人: | 陈红;楼仙英 |
地址: | 台湾*** | 国省代码: | 中国台湾;71 |
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摘要: | 本发明涉及一种多位存储单元,包括:一半导体基底;一突状基底,形成于半导体基底上;一离子植入区,位于突状基底的顶部两侧;一间隙壁,形成于突状基底的侧壁;一掺入离子区,位于半导体基底,且掺入离子区露出于半导体基底表面;及一氧-氮-氧化物层,顺应性形成于突状基底、间隙壁、露出表面的掺入离子区及半导体基底的表面上。 | ||
搜索关键词: | 存储 单元 及其 制造 方法 | ||
【主权项】:
1.一种多位存储单元的制造方法,其特征在于,包括下列步骤:提供一半导体基底,该半导体基底上形成有一半导体基底及一硬罩幕层;以该硬罩幕层为罩幕,对该半导体基底进行离子植入以形成一离子植入区;于该硬罩幕侧壁形成一第一间隙壁;以该硬罩幕及该第一间隙壁为罩幕,非等向性蚀刻该半导体基底以露出该半导体基底表面;于该半导体基底及该第一间隙壁的侧壁形成一第二间隙壁;以该硬罩幕及该第二间隙壁为罩幕非等向性蚀刻该半导体基底以形成一开口,并去除该第二间隙壁;于该半导体基底上形成一离子掺入层,非等向性蚀刻该掺入离子层以在该半导体基底侧壁形成一第三间隙壁,且该掺入离子层会填满该开口;及去除该硬罩幕层及该第一间隙壁后,于该半导体基底上顺应性形成一氧-氮-氧化物层。
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H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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