[发明专利]生成掩膜数据、掩膜、记录介质的方法和制造半导体器件的方法无效
申请号: | 02141622.2 | 申请日: | 2002-09-06 |
公开(公告)号: | CN1405858A | 公开(公告)日: | 2003-03-26 |
发明(设计)人: | 森克己 | 申请(专利权)人: | 精工爱普生株式会社 |
主分类号: | H01L21/31 | 分类号: | H01L21/31;H01L21/027;G03F7/00 |
代理公司: | 北京康信知识产权代理有限责任公司 | 代理人: | 余刚 |
地址: | 日本*** | 国省代码: | 暂无信息 |
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摘要: | 本发明提供了一种生成掩膜数据、掩膜、以及记录介质的方法和制造半导体器件的方法,该方法应用于具有优良填充性的层间绝缘层的半导体器件的制造中,该层间绝缘层按照0.13μm设计规则,在相邻布线层的间隔中形成。本发明还提供了一种生成掩膜数据、掩膜、以及记录介质的方法和制造半导体器件的方法。该半导体器件包括位于基板指定图案中的布线层和位于基板上指定图案中的应力减轻层。生成掩膜数据的方法包括通过施加一个正(+)调整量来调整布线层图案(120)的大小,用以形成调整大小后的图案(130)的步骤,删除调整大小后相互重叠的那些图案(130)的步骤,和调整大小后的图案外面形成具有特定宽度的应力减轻层图案的步骤。 | ||
搜索关键词: | 生成 数据 掩膜 记录 介质 方法 制造 半导体器件 | ||
【主权项】:
1.一种生成掩膜数据的方法,所述方法用于制造半导体器件,所述半导体器件包括按指定图案配置在基板上的布线层和按定图案配置在所述基板上的应力减轻层,所述方法包括以下步骤:通过施加一个正(+)调整量来调整布线层图案的大小,用以形成调整后的图案;在所述调整后的图案中删除相互重叠的调整后的图案;以及在所述调整后的图案外面形成具有特定宽度的应力减轻层图案。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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