[发明专利]高速存储系统中同步读出定时的方法无效
| 申请号： | 02808632.5 | 申请日： | 2002-02-01 |
| 公开（公告）号： | CN1503974A | 公开（公告）日： | 2004-06-09 |
| 发明（设计）人： | J·W·詹森;T·A·曼林格;C·G·马丁;B·基斯 | 申请（专利权）人： | 微米技术有限公司 |
| 主分类号： | G11C7/22 | 分类号： | G11C7/22;G11C11/409;G11C7/10;G11C7/20;G11C11/4072;G06F13/42 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 王岳;王勇 |
| 地址： | 美国爱*** | 国省代码： | 美国;US |
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| 摘要： | 通过使用至少一个标记信号使得高速同步存储子系统中的多个存储设备的读出反应时间相等。该标记信号的信号传播特性与读出时钟信号相等，从而自动补偿信号传播差。在检测到标记信号后，存储设备将在预定个数的时钟周期时开始输出与先前接收的读出命令相关的数据。对于每个标记信号，存储控制器在系统初始化时，检测发出读出命令与发出标记信号之间要求的延迟，以便使系统读出反应时间相等。然后该延迟在存储系统的正常操作中被应用于读出处理。 | ||
| 搜索关键词： | 高速 存储系统 同步 读出 定时 方法 | ||
【主权项】：
1.一种存储设备，包括：存储阵列；耦合到所述存储阵列的至少一个数据信号线；控制电路；耦合到所述控制电路的读出时钟信号线，用于接收读出时钟信号；耦合到所述控制电路的标记信号线，用于接收标记信号；耦合到所述控制电路的至少一个命令信号线，用于接收命令；且其中，所述控制电路使得存储设备从与先前在所述至少一个数据信号线上接收到的命令关联的所述阵列输出数据，所述输出在控制电路接收到标记信号之后预定个数的读出时钟周期时开始。
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