[发明专利]内存单元排列之驱动电路及操作模式无效
| 申请号： | 02815093.7 | 申请日： | 2002-07-24 |
| 公开（公告）号： | CN1537311A | 公开（公告）日： | 2004-10-13 |
| 发明（设计）人： | C·比得斯;H·塞德拉克 | 申请（专利权）人： | 因芬尼昂技术股份公司 |
| 主分类号： | G11C16/26 | 分类号： | G11C16/26;G11C7/14 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 程天正;梁永 |
| 地址： | 德国*** | 国省代码： | 德国;DE |
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| 摘要： | 具有16至32个内存单元之内存单元组之一选择晶体管(2)，系被插入至该内存单元(4)之导线。为了读取，开启一列组之该选择晶体管，而所有列的控制栅极系为低电位，且读取每一行之电流，其系透过该列组被测量与储存。在第二步骤中，被读取列的控制栅极(5)系被提升至更高的读取电位，且所得电流系与先前的电流相比较。 | ||
| 搜索关键词： | 内存 单元 排列 驱动 电路 操作 模式 | ||
【主权项】：
1.一种驱动电路，用于一内存单元排列，其具有各被分配到一记体单元的内存晶体管(1)的排列，且具有一驱动电路，其系用于一内存晶体管之选择，以及用于存写或读取一信息项目至或自该内存单元，其特征系为：内存晶体管组系被分配一选择晶体管(2)，因而该内存晶体管组可被连带地选择。
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