[发明专利]减小了定时抖动的早-迟同步器有效

专利信息
申请号: 02829891.8 申请日: 2002-11-15
公开(公告)号: CN1695314A 公开(公告)日: 2005-11-09
发明(设计)人: 多纳托·艾拖瑞;毛瑞兹奥·格瑞泽诺;布鲁诺·迈利斯;安德瑞·费诺泰罗;阿尔弗莱多·拉希托 申请(专利权)人: 意大利电信股份公司
主分类号: H04B1/707 分类号: H04B1/707
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 李玲
地址: 意大*** 国省代码: 意大利;IT
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摘要: 发明涉及在数字通信接收机中保持输入扩频信号与本地生成码之间精细校准的设备,包括:延迟线,用于保存输入扩频信号的多个连续采样(E-1、E、M、L、L+1);三个数控内插器,用于在连续采样之间执行内插来确定内插早、中、晚采样(e、m、l);二个相关器用于从内插早采样(e)与内插晚采样(l)中计算的符号能量之间的差值计算误差信号(ξ);用于产生控制信号(SOUT)以控制对应早采样(e)的数控内插器(24)的内插相位的电路;和数字非线性滤波器(68),用于平滑对应于早采样(e)的内插器(24)的控制信号(SOUT)以只在时刻n的误差信号绝对值(|ξ(n)|)小于时刻n-1的同一个误差信号绝对值(|ξ(n-1)|)的时候才对控制信号执行更新操作。
搜索关键词: 减小 定时 抖动 同步器
【主权项】:
1.一种用于对数字电信接收机进行精细同步的方法,包括用于在输入扩频信号与本地生成码之间保持精细校准的码追踪处理,所述方法包括:将所述输入扩频信号的多个连续采样(E-1、E、M、L、L+1)保存在延迟线(56)中;借助第一数控内插器(26)而在所述输入扩频信号的连续采样之间执行内插,从而确定用于预期最佳采样时刻的内插早采样(e);借助第二数控内插器(24)而在所述输入扩频信号的连续采样之间执行内插,从而确定与所述最佳采样时刻相对应的内插中采样(m);借助第三数控内插器(28)而在所述输入扩频信号的连续采样之间执行内插,从而确定相对于所述最佳采样时刻而被延迟的内插晚采样(l);计算误差信号(ξ),以此作为从所述内插早采样(e)与晚采样(l)中计算的符号能量之间的差值;从所述误差信号(ξ)中产生用于控制所述第二数控内插器(24)的内插相位的控制信号(SOUT);其特征在于:所述产生控制信号(SOUT)的步骤包括:提取所述误差信号(ξ)的正负号;累积所述误差信号(ξ)的所述正负号,以便产生中间控制信号(SM);计算时刻n的所述误差信号(ξ)的绝对值(|ξ|);对所述时刻n的所述误差信号(ξ)的所述绝对值|ξ(n)|以及之前时刻n-1的所述误差信号(ξ)的绝对值(|ξ(n-1)|)进行比较;如果时间n的所述误差信号的绝对值(|ξ(n)|)小于时间n-1的同一个误差信号的绝对值(|ξ(n-1)|),则将所述控制信号(SOUT)更新成所述中间控制信号(SM)的值,否则保持所述控制信号(SOUT)的值不变。
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