[发明专利]半导体芯片安装衬底和平面显示器无效
申请号: | 03101758.4 | 申请日: | 2003-01-21 |
公开(公告)号: | CN1435808A | 公开(公告)日: | 2003-08-13 |
发明(设计)人: | 河田外与志;佐野勇司 | 申请(专利权)人: | 富士通日立等离子显示器股份有限公司 |
主分类号: | G09G3/28 | 分类号: | G09G3/28 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 | 代理人: | 王永刚 |
地址: | 暂无信息 | 国省代码: | 暂无信息 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 提供一种半导体芯片安装衬底,其具有半导体裸芯片和通过引线接合电连接到该半导体裸芯片的衬底。这里,保护膜在半导体裸芯片表面上提供并且被布置以暴露接合线的全部和部分。 | ||
搜索关键词: | 半导体 芯片 安装 衬底 平面 显示器 | ||
【主权项】:
1.一种半导体芯片安装衬底,包括:半导体裸芯片;通过引线接合电连接到所述半导体裸芯片的衬底;在所述半导体裸芯片表面上提供并且被布置以暴露接合线的全部和部分的第一保护膜。
下载完整专利技术内容需要扣除积分,VIP会员可以免费下载。
该专利技术资料仅供研究查看技术是否侵权等信息,商用须获得专利权人授权。该专利全部权利属于富士通日立等离子显示器股份有限公司,未经富士通日立等离子显示器股份有限公司许可,擅自商用是侵权行为。如果您想购买此专利、获得商业授权和技术合作,请联系【客服】
本文链接:http://www.vipzhuanli.com/patent/03101758.4/,转载请声明来源钻瓜专利网。
- 上一篇:制造陶瓷叠层的设备和方法
- 下一篇:陶瓷叠层及其制造方法