[发明专利]带有可重切换缓存的数字信号处理器无效
| 申请号： | 03115374.7 | 申请日： | 2003-02-13 |
| 公开（公告）号： | CN1521631A | 公开（公告）日： | 2004-08-18 |
| 发明（设计）人： | 陈进 | 申请（专利权）人： | 上海汉芯半导体科技有限公司 |
| 主分类号： | G06F12/00 | 分类号： | G06F12/00;G06F13/14;G06F9/30 |
| 代理公司： | 上海交达专利事务所 | 代理人： | 王锡麟 |
| 地址： | 20110*** | 国省代码： | 上海;31 |
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| 摘要： | 一种带有可重切换缓存的数字信号处理器，属于数字信号处理技术领域。主要包括：程序控制单元、地址发生器单元、指令译码单元、数字数据处理单元、片内数字数据存储器、片外数字数据存储器、选择器、命中判断逻辑器，本发明提供一种带有可重切换缓存的数字信号处理器，改进了现有的缓存的设计，使其可以通过一个端口的设置，把片上缓存改成一般的片上内存，这样在运行小程序时，可以进行准确而高效的内存访问操作。它使得片上存储体可以被配置成片上缓存或者片上内存。这样大大增加了芯片应用于不同的应用场合的灵活性，提高了芯片的性价比。 | ||
| 搜索关键词： | 带有 切换 缓存 数字信号 处理器 | ||
【主权项】：
1.一种带有可重切换缓存的数字信号处理器，主要包括：程序控制单元(1)、地址发生器单元(2)、指令译码单元(3)、数字数据处理单元(4)、地址和控制总线(29)，其特征在于还包括：片内数字数据存储器(6)、片外数字数据存储器(7)、选择器(14)、命中判断逻辑(13)，指令译码单元(3)连接到程序控制单元，程序控制单元(1)连接到地址发生单元、指令译码单元(3)和数字数据处理单元(4)，数字数据处理单元(4)双向连接到片内数字数据存储器(6)，地址发生器单元(2)由地址总线连接到片内数字数据存储器(6)，同时片内数字数据存储器(6)由数据总线连接到地址发生器单元(2)、指令译码单元(3)和数字数据处理单元(4)，片内数字数据存储器(6)和片外数字数据存储器(7)相连，数字数据总线与数字数据存储器(6)相连，程序控制单元(1)根据所述指令生成控制所述数字信号处理器的其他单元的操作的命令信号，设置一个特定的外围端口，将片内数字数据存储器(6)中物理存储体作为普通片上内存或者缓存使用，外围端口信号连接到片内数字数据存储器(6)中的选择器(14)上，地址和控制总线(29)一路连接到命中判断逻辑(13)上，另一路直接连接到选择器上，选择器(14)通过总线(28)连接到16位片上存储体(11)。
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