[发明专利]用于存储数据信号的编码方式无效
申请号: | 03153065.6 | 申请日: | 1999-04-27 |
公开(公告)号: | CN1574024A | 公开(公告)日: | 2005-02-02 |
发明(设计)人: | S·J·W·埃迪里索里雅 | 申请(专利权)人: | 英特尔公司 |
主分类号: | G11B20/18 | 分类号: | G11B20/18;G06F11/10 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 王忠忠 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | 按照本发明中的一个实施例,一种用于编码存储的数据信号以对存储介质中的存储单元进行容错的方法包含以下内容:有N+2个存储单元(110,120,130,140,150,160),N是一个正整数,又将每个存储单元分成N个存储块(D0,0...D3,0;D0,1...D3,1;D0,2...D3,2;D0,3...D3,3;D0,4...D3,4;D0,5...D3,5),则由(N)(N)块数据信号会产生出2N个奇偶校验信号块。将2N个奇偶校验信号块分配存储在N+2个存储单元中,以使2N个奇偶校验信号块不是仅仅存储在N+2个存储单元的其中两个单元中。 | ||
搜索关键词: | 用于 存储 数据 信号 编码 方式 | ||
【主权项】:
1.一种存储介质,包含:N+2个存储二进制数字信号的存储单元,N是一个正整数,又将每个存储单元分成N个存储块,在所述的N+2个存储单元上存储了2N个奇偶校验信号块和(N)(N)个数据信号块,其中2N个奇偶校验信号块是以(N)(N)个数据信号块为基础的;将所述的2N个奇偶校验信号块分配存储在N+2个存储单元中,以使2N个奇偶校验信号块不是仅仅存储在N+2个存储单元中的其中两个单元上。
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