[实用新型]一种数字锁相环无效
| 申请号： | 03229265.1 | 申请日： | 2003-03-07 |
| 公开（公告）号： | CN2606494Y | 公开（公告）日： | 2004-03-10 |
| 发明（设计）人： | 陈良生 | 申请（专利权）人： | 上海华虹集成电路有限责任公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/18 |
| 代理公司： | 上海专利商标事务所 | 代理人： | 陈亮 |
| 地址： | 20023*** | 国省代码： | 上海;31 |
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| 摘要： | 一种数字锁相环，包括：延时单元组，其输入为基准时钟信号u1，该延时单元组包括数个级联的延时单元，每一个延时单元包括一个延时器和一个状态控制器；倒相器，其输入端与各级延时单元的状态控制器的输出端相连；多路选择器，其输入端与倒相器的输出端以及各级延时单元的状态控制器的输出端相连；第一触发器，其输入端与多路选择器的输出端相连；延时器，其输入端与多路选择器的输出端相连；第二触发器，其输入端与延时器的输出端相连；相位比较器，其输入端与第一触发器以及第二触发器的输出端相连，其输出端与多路选择器的输入端相连；计数器，其输入端与相位比较器的输出端相连；译码电路，其输入端与计数器的输出端相连，其输出端与延时单元组中的各级延时单元的状态控制器的输入端相连。 | ||
| 搜索关键词： | 一种 数字 锁相环 | ||
【主权项】：
1.一种数字锁相环，其特征在于，包括：延时单元组(11)，延时单元组(11)的输入为基准时钟信号u1，该延时单元组包括数个级联的延时单元，每一个延时单元包括一个延时器和一个状态控制器，所述延时器的输出端连接到本延时单元的状态控制器的输入端以及下级延时单元的延时器的输入端，所述各级延时单元的状态控制器的输出端都相连；倒相器(12)，倒相器(12)的输入端与所述各级延时单元的状态控制器的输出端相连；多路选择器(13)，多路选择器(13)的输入端与所述倒相器(12)的输出端以及所述各级延时单元的状态控制器的输出端相连；第一触发器(14)，第一触发器(14)的输入端与所述多路选择器(13)的输出端相连，其时钟输入信号为相位参考时钟u2；延时器(16)，延时器(16)的输入端与所述多路选择器(13)的输出端相连；第二触发器(15)，第二触发器(15)的输入端与所述延时器(16)的输出端相连，其时钟输入信号为相位参考时钟u2；相位比较器(17)，相位比较器(17)的输入端与所述第一触发器(14)的输出端以及所述第二触发器(15)的输出端相连，其输出端与所述多路选择器(13)的输入端相连；计数器(18)，计数器(18)的输入端与所述相位比较器(17)的输出端相连；译码电路(19)，译码电路(19)的输入端与所述计数器(18)的输出端相连，其输出端与所述延时单元组(11)中的各级延时单元的状态控制器的输入端相连；
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