[发明专利]电路制作方法有效

专利信息
申请号: 03800694.4 申请日: 2003-05-19
公开(公告)号: CN1533607A 公开(公告)日: 2004-09-29
发明(设计)人: 武生川濑 申请(专利权)人: 精工爱普生株式会社
主分类号: H01L27/15 分类号: H01L27/15;G02F1/1333;G09G3/32
代理公司: 中科专利商标代理有限责任公司 代理人: 朱进桂
地址: 日本*** 国省代码: 日本;JP
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摘要: 利用蚀刻平板印刷技术与喷墨印制技术相结合制作薄膜电路。提供了非常高分辨率的蚀刻平板印刷技术用于制作晶体管源电极和漏电极、部分互连和电路电极,可以使用高导电材料。利用喷墨印制技术形成半导体区、绝缘体区、栅电极、特别是横跨点互连的其它部分互连的图案。在喷墨印制技术中能够使用各种不同材料,特别在使用塑料基底时,实质上缓解了与使用多个蚀刻平板印刷步骤相关联的校准困难。
搜索关键词: 电路 制作方法
【主权项】:
1.一种电路制作方法,包括利用蚀刻平板印刷技术在基底上形成包括排列于其它导电材料区之间的第一导电材料区的形成图案层;利用喷墨印制技术有选择地印制沉积绝缘体材料,使其延展到至少部分第一导电材料区上以提供绝缘体材料局部区域,使得提供的半导体或导体域延伸到该第一导电材料之上但与之绝缘,并延伸再其它它导电材料区域之间。
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