[发明专利]具有内部高速缓存和/或内存访问预测的内存集线器无效
| 申请号： | 03818759.0 | 申请日： | 2003-06-06 |
| 公开（公告）号： | CN1675625A | 公开（公告）日： | 2005-09-28 |
| 发明（设计）人： | 约瑟夫·杰德洛 | 申请（专利权）人： | 米克伦技术公司 |
| 主分类号： | G06F12/06 | 分类号： | G06F12/06 |
| 代理公司： | 永新专利商标代理有限公司 | 代理人： | 王英 |
| 地址： | 美国*** | 国省代码： | 美国;US |
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| 摘要： | 一种计算机系统，包括用于将处理器(104)耦合到多个同步动态随机访问内存(“SDRAM”)设备的内存集线器(130)。内存集线器(130)包括耦合到处理器(104)的处理器接(150)以及耦合到相应的SDRAM设备(140a－c)的多个内存接口(170a－c)。处理器接(150)通过开关(160)耦合到内存接口(170a－c)。内存接口(170a－c)的每一个包括一个内存控制器(180)、一个高速缓存(184)和一个预测单元(190)。高速缓存(184)存储最近从相应的SDRAM设备(140a－c)读取的或者写入到相应的SDRAM设备(140a－c)的数据，使得其随后可以由处理器(104)以相当小的延迟读取。预测单元(190)基于以前被访问的地址，从可能的读取访问的地址预取数据。 | ||
| 搜索关键词： | 具有 内部 高速缓存 内存 访问 预测 集线器 | ||
【主权项】：
1、一种内存集线器，包括：一个内存访问设备接口，配置成与内存访问设备连接；多个内存接口，配置成与相应的内存设备连接，该多个内存接口的每一个包括一个内存控制器和一个高速缓存；以及一个开关，使该内存访问设备接口与该多个内存接口的每一个相耦合。
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