[发明专利]用于将高频数字输入信号数模转换成载频模拟输出信号的装置无效
| 申请号： | 03819857.6 | 申请日： | 2003-07-28 |
| 公开（公告）号： | CN1739240A | 公开（公告）日： | 2006-02-22 |
| 发明（设计）人： | A·福赫斯;B·耶隆内克;G·沃尔夫 | 申请（专利权）人： | 西门子公司 |
| 主分类号： | H03M1/00 | 分类号： | H03M1/00 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 程天正;张志醒 |
| 地址： | 德国*** | 国省代码： | 德国;DE |
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| 摘要： | 用于数模转换的装置具有带有至少一个第一延迟元件的延迟设备，其中，必要时其它的延迟元件彼此相继串联地连接在第一延迟元件之后。数字输入信号一方面接通到第一延迟元件的输入端上，而另一方面接通到第一D/A转换器的输入端上。第一延迟元件在输出侧与分配给它的其它D/A转换器的输入端相连接。必要时其它的延迟元件分别在输出侧与分配给各个延迟元件的其它D/A转换器的输入端相连接。在输出侧逐级地如此来汇总所有的D/A转换器，使得所有D/A转换器的输出信号形成模拟输出信号。如此来给每个D/A转换器分配一个专门的系数，而给每个延迟元件分配一个专门的延迟时间，使得实现一种滤波器特性。 | ||
| 搜索关键词： | 用于 高频 数字 输入 信号 数模 转换 载频 模拟 输出 装置 | ||
【主权项】：
1.用于将高频数字输入信号(DE)数模转换成载频模拟输出信号(AA)的装置，-其中，延迟设备(VZ)具有至少一个第一延迟元件(VG1)，而其它的延迟元件(VG2，...，VGn)彼此相继串联地连接在所述的第一延迟元件之后，-其中，所述的数字输入信号(DE)一方面接通到所述的第一延迟元件(VG1)的输入端上，而另一方面接通到第一D/A转换器(W0)的输入端上，-其中，所述的第一延迟元件(VG1)在输出侧与分配给它的另一个D/A转换器(W1)的输入端相连接，并且必要时每个其它的延迟元件(VG2，...，VGn)在输出侧与分配给所述各个延迟元件(VG2，...，VGn)的其它D/A转换器(W2，...，Wn)的输入端相连接，-其中，在输出侧逐级地如此来汇总所有D/A转换器(W0，...，Wn)，使得所有D/A转换器(W0，...，Wn)的输出信号(AS0，...，ASn)形成所述的模拟输出信号(AA)，以及-其中，给每个D/A转换器(W0，...，Wn)分配一个专门的系数(k0，...，kn)，而给每个延迟元件(VG1，...，VGn)分配一个专门的延迟时间(τ1，...，τn)，用于实现一种滤波器特性。
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