[发明专利]高速零直流功耗可编程逻辑器件结构无效
| 申请号： | 03825198.1 | 申请日： | 2003-08-06 |
| 公开（公告）号： | CN1695304A | 公开（公告）日： | 2005-11-09 |
| 发明（设计）人： | 萨罗杰·帕塔克;詹姆斯·E·佩恩;V·V·恩古耶;H·H·库 | 申请（专利权）人： | 爱特梅尔股份有限公司 |
| 主分类号： | H03K19/177 | 分类号： | H03K19/177 |
| 代理公司： | 上海专利商标事务所有限公司 | 代理人： | 李玲 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 一种可编程逻辑器件(PLD)结构包括多个PLD一位逻辑单元(图3)。每个一位逻辑单元由所有的CMOS逻辑器件组成，包括可编程单元装置(330－333)、可设定锁存器(320－323)、信号通路装置(360A，360B)和输出逻辑门(350)。信号通路装置耦合之单元装置、可设定锁存器和输出逻辑门，以造成正反馈来改善速度和抗噪声度。每个一位逻辑门是一个基本的积木式部件(402－408)，用于构造积木化的低功耗、高速、零直流电流、高抗噪声度的可编程逻辑器件(PLD)(700)它包括按行与列排列的用于寻址的字线(pwd)和位线(vcol，pcol)的阵列、OR门阵列(740)以及多个输出逻辑电路(750)。 | ||
| 搜索关键词： | 高速 直流 功耗 可编程 逻辑 器件 结构 | ||
【主权项】：
1.一种可编程逻辑器件(PLD)一位单元，其特征在于该PLD一位单元包括：用于存储单位的可编程单元装置，它具有多个端子；电耦合至可编程单元装置的可设定锁存器，用于把来自可编程单元装置的一位锁存入其中；耦合至可设定锁存器的输出逻辑门；以及信号通路装置，用于在可设定锁存器和可编程单元装置之间提供正反馈，把所述信号通路装置电耦合在可编程单元装置和输出逻辑门之间。
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