[发明专利]包括西格玛-德尔塔调制器的可变频合成器有效

专利信息
申请号: 03825623.1 申请日: 2003-07-25
公开(公告)号: CN1714510A 公开(公告)日: 2005-12-28
发明(设计)人: 巴尔多·米勒;约尔格·许斯特;托马斯·穆施 申请(专利权)人: 富士通株式会社
主分类号: H03L7/197 分类号: H03L7/197
代理公司: 北京三友知识产权代理有限公司 代理人: 李辉
地址: 日本神*** 国省代码: 日本;JP
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摘要: 提供了一种包括西格玛-德尔塔调制器的可变频合成器。这样的合成器提供确切的平均频率,尽管瞬时频率是变化的。所述西格玛-德尔塔调制器包括多个串联连接的累加器级。作为西格玛-德尔塔调制器的组成部分的累加器(51,52,53,54)的至少一个输入值具有第二分量,该第二分量等于溢出信号(of1,of2,of3,of4)乘以一个系数。这一反馈减小了瞬时频率的最大波动。因此减小了由相位检测器、电荷泵和VCO的非线性产生的相位抖动。
搜索关键词: 包括 西格玛 德尔塔 调制器 变频 合成器
【主权项】:
1.一种可变频合成器,包括:—压控振荡器(VCO),该压控振荡器生成频率取决于施加给所述压控振荡器(VCO)的输入信号(ucp)的振荡器信号(uVCO);—分频器,该分频器接收所述振荡器信号并且产生频率等于所述振荡器信号的频率除以分频器比率的分频器信号(uDIV);—相位检测器(PD),该相位检测器根据所述分频器信号(uDIV)与基准信号(uREF)之间的相位差提供相位差信号(uPD),所述相位差信号决定施加给所述压控振荡器的所述输入信号;—分频器比率控制器(DRC),包括西格玛—德尔塔调制器并且提供所述分频器比率,所述西格玛—德尔塔调制器包括多个串联连接的累加器级,每个累加器级合计输入值并且在达到最大值的时候给出溢出信号,所述串联中的第一累加器级接收预期平均分频器比率的小数部分作为输入值的第一分量,各个后续累加器接收位于所述后续累加器之前并且与所述后续累加器相邻的累加器的累加器值作为输入值的第一分量,各个溢出信号值被微分与所述串联中处于提供所述各个溢出信号值的累加器之前的累加器的级数相同的次数,之后合计所有的溢出信号值以形成所述西格玛—德尔塔调制器的输出信号,所述分频器比率是所述西格玛—德尔塔调制器的所述输出信号与预期平均分频器比率的整数部分的和;其特征在于:至少一个输入值具有第二分量,该第二分量等于溢出信号乘以一个系数。
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