[发明专利]总线电路装置及系统无效
| 申请号： | 200310112163.0 | 申请日： | 2003-11-10 |
| 公开（公告）号： | CN1617119A | 公开（公告）日： | 2005-05-18 |
| 发明（设计）人： | 许俊彬 | 申请（专利权）人： | 鸿富锦精密工业（深圳）有限公司;鸿海精密工业股份有限公司 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518109广东省深圳市*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明提供一种可弹性串接扩充在总线上的电路装置。该总线电路装置包括：一功能芯片；一二进制加法运算器，用于设定该总线电路装置的总线地址；一位于该电路装置输入端的第一连接器；以及一位于该电路装置输出端的第二连接器。本发明还提供一种可弹性串接扩充在总线上的电路系统。该总线电路系统包括：一实现控制功能的控制电路装置；至少一总线电路装置，该总线电路装置进一步包括：一功能芯片、一第一连接器、一第二连接器、以及一二进制加法运算器，用于设定该总线电路装置的总线地址。 | ||
| 搜索关键词： | 总线 电路 装置 系统 | ||
【主权项】：
1.一种总线电路装置，包括：一功能芯片，其具有至少一功能管脚以及至少一地址管脚；一第一连接器，其位于该电路装置的输入端，并具有至少一地址端子，以及至少一功能端子与该功能芯片的功能管脚相连；一第二连接器，其位于该电路装置的输出端，其具有至少一功能端子与第一连接器的功能端子相连，以及至少一地址端子；以及一加法运算器，其具有至少一输入管脚与一输出管脚，该输入管脚与第一连接器的地址端子相连，该输出管脚与该芯片的地址管脚相连。
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