[发明专利]具有占空比校正电路的模拟延迟锁相环有效
| 申请号： | 200310124217.5 | 申请日： | 2003-12-31 |
| 公开（公告）号： | CN1518226A | 公开（公告）日： | 2004-08-04 |
| 发明（设计）人： | 金世埈;洪祥熏;高在范 | 申请（专利权）人： | 海力士半导体有限公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/00 |
| 代理公司： | 北京集佳知识产权代理有限公司 | 代理人： | 王学强 |
| 地址： | 韩国京畿*** | 国省代码： | 韩国;KR |
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| 摘要： | 一个模拟延迟锁相环器件，包括第一模块，用来接收内部时钟信号和参考时钟信号，产生正常多相时钟信号对和虚拟多相时钟信号对；和第二模块，用来接收参考时钟信号，以产生一个具有校正的占空比的延迟锁相内部时钟信号，所述校正的占空比基于正常多相时钟信号对和虚拟多相时钟信号对。 | ||
| 搜索关键词： | 具有 校正 电路 模拟 延迟 锁相环 | ||
【主权项】：
1、一种模拟延迟锁相环器件，包括：第一板块，用于接收内部时钟信号和参考时钟信号，以产生正常多相时钟信号对和虚拟多相时钟信号对；第二板块，用于接收参考时钟信号，以产生一个具有校正的占空比的延迟锁相内部时钟信号，所述校正的占空比基于正常多相时钟信号对和虚拟多相时钟信号对。
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