[发明专利]PLL电路无效

专利信息
申请号: 200380103727.2 申请日: 2003-11-21
公开(公告)号: CN1714509A 公开(公告)日: 2005-12-28
发明(设计)人: 前多正;松野典朗;沼田圭市 申请(专利权)人: 日本电气株式会社
主分类号: H03L7/10 分类号: H03L7/10;H03L7/199;H03L7/18
代理公司: 中科专利商标代理有限责任公司 代理人: 汪惠民
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种PLL电路,具有:相位比较机构,其对基准信号和内部信号的相位进行比较,并输出与其相位差对应的相位差信号;多个振荡器,其具有互不相同的频率可变范围,且根据各个相位控制信号控制振荡频率;选择机构,其根据相位差信号或相位控制信号,选择多个振荡器的输出中的1个;和分频机构,其通过将由选择机构选择的振荡器的输出分频,生成内部信号;并且,在振荡器的选择状态发生变化时使所述分频器的输出相位与基准信号的相位接近。由此,可根据所期望的振荡频率,在短时间内选择所需的电压控制振荡器。
搜索关键词: pll 电路
【主权项】:
1.一种PLL电路,其特征在于,具有:相位比较机构,其对基准信号和内部信号的相位进行比较,并输出与其相位差对应的相位差信号;多个振荡器,其具有互不相同的频率可变范围,且根据各个相位控制信号控制振荡频率;选择机构,其根据所述相位差信号或所述相位控制信号,选择所述多个振荡器的输出中的1个;和分频机构,其通过将由所述选择机构选择的振荡器的输出分频,生成所述内部信号;还具有在所述振荡器的选择状态发生变化时使所述分频器的输出相位与所述基准信号的相位接近的机构。
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