[发明专利]半导体多层布线形成方法无效
申请号: | 200380104369.7 | 申请日: | 2003-11-27 |
公开(公告)号: | CN1717797A | 公开(公告)日: | 2006-01-04 |
发明(设计)人: | 萩原嘉男;田中健 | 申请(专利权)人: | 东京応化工业株式会社 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L21/3205;H01L21/3213 |
代理公司: | 中国专利代理(香港)有限公司 | 代理人: | 郭煜;庞立志 |
地址: | 日本*** | 国省代码: | 日本;JP |
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摘要: | 一种通过采用导体材料埋入形成于层间绝缘层的第1蚀刻空间和与之连通的第2蚀刻空间,来形成多层布线结构的使用了双重镶嵌工艺的布线形成方法,在该形成方法中,不使构成层间绝缘层的低介电层劣化并能削减工序数,同时提高工序管理的自由度。因此,为了保护下层布线层不受用于形成第2蚀刻空间形成用的光刻胶图形的曝光光的影响,作为填充到第1蚀刻空间内的材料,使用不会损伤层间绝缘层且利用剥离液能够容易地去除的以旋压玻璃材料为主成分的填埋材料,同时在该填埋材料中不添加用于吸收曝光光的吸光材料,而是在填埋材料层的上面形成可通过干法蚀刻来加工的防反射膜、或形成显影液可溶性的防反射膜。 | ||
搜索关键词: | 半导体 多层 布线 形成 方法 | ||
【主权项】:
1.一种半导体多层布线形成方法,该方法是在半导体衬底上形成的下层布线层、和在其上面通过层间绝缘层形成的上层布线层通过上下贯通所述层间绝缘层的通路布线连接的半导体多层布线的形成方法,其特征在于,在该形成方法中,具有下述的工序:在上述下层布线层上层叠至少由低介电层构成的上述层间绝缘层的层间绝缘层形成工序;在上述层间绝缘层上形成光刻胶层,图形曝光之后进行显影处理,形成光刻胶图形,以该光刻胶图形为掩模进行蚀刻,在上述层间绝缘层上形成第1蚀刻空间的第1蚀刻空间形成工序;通过在上述层间绝缘层上涂布至少以旋压玻璃材料为主成分的填埋材料,向上述第1蚀刻空间埋入上述填埋材料的填埋工序;在形成于上述层间绝缘层上的填埋材料层之上形成可通过干法蚀刻来加工的防反射膜的防反射膜形成工序;在上述防反射膜上形成光刻胶层,向该光刻胶层照射图形光,利用碱性显影液显影,形成光刻胶图形的光刻胶图形形成工序;以上述光刻胶图形为掩模,通过干法蚀刻来加工上述防反射膜的暴露部分的防反射膜加工工序;以上述光刻胶图形为掩模进行蚀刻,将上述第1蚀刻空间的上部的上述层间绝缘层去除成为所预定的图形,形成与上述第1蚀刻空间连通的第2蚀刻空间的同时,去除上述第1蚀刻空间内的填埋材料的第2蚀刻空间形成及填埋材料去除工序;同时地用导体材料填埋上述第1蚀刻空间和第2蚀刻空间,并同时地形成上述通路布线和上层布线层的布线一次性形成工序。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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