[发明专利]用于在同步多线程处理器中改变流水线长度的方法和电路无效

专利信息
申请号: 200410034883.4 申请日: 2004-04-15
公开(公告)号: CN1540498A 公开(公告)日: 2004-10-27
发明(设计)人: 戴维·S·莱维坦;巴拉兰·辛哈罗伊 申请(专利权)人: 国际商业机器公司
主分类号: G06F9/38 分类号: G06F9/38
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 付建军
地址: 美国*** 国省代码: 美国;US
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摘要: 一种SMT系统具有单线程模式和SMT模式。在每个时钟周期从两个线程交替地选择指令,并在IFU的三周期流水线中将其载入到IFAR。如果在流水线的第三级在分支预测电路中检测出预测采纳的分支指令,则在单线程模式中,在下一个时钟周期将从分支预测电路计算出的地址载入到IFAR。如果在SMT模式中,分支预测电路中的指令检测出预测采纳的分支,则在检测出预测采纳的分支之后的第一个时钟周期,将所选指令地址载入到IFAR。在检测出预测采纳的分支之后的第二个时钟周期,将计算出的目标地址反馈并载入到IFAR。反馈延迟有效地将流水线由三级切换为四级。
搜索关键词: 用于 同步 多线程 处理器 改变 流水线 长度 方法 电路
【主权项】:
1.一种用于在具有同步多线程(SMT)模式和单线程模式的SMT处理器中操作处理第一和第二线程数据的共享流水线电路的方法,包括:交替地对所述共享流水线电路的输入级进行载入,在第一时钟时间使用来自所述第一线程的数据,在第二时钟时间使用来自所述第二线程的数据;在所述输入级之后的流水线级中产生用于所述第一线程的第一数据;如果选择所述SMT模式对在所述第一时钟时间内利用所述第一数据对所述输入级的载入进行同步,则将所述第一数据通过延迟路径连接至所述输入级;和如果选择所述单线程模式,则将所述第一数据直接连接回所述输入级。
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