[发明专利]非易失性存储器并行处理器无效
| 申请号： | 200410045747.5 | 申请日： | 2004-05-24 |
| 公开（公告）号： | CN1577312A | 公开（公告）日： | 2005-02-09 |
| 发明（设计）人： | M·沙马;F·A·佩尔纳 | 申请（专利权）人： | 惠普开发有限公司 |
| 主分类号： | G06F15/16 | 分类号： | G06F15/16;G11C11/15 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 程天正;梁永 |
| 地址： | 美国德*** | 国省代码： | 美国;US |
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| 摘要： | 本发明包括并行处理器。并行处理器包括多个非易失性存储单元[110、112、114、116]。并行处理器还包括多个处理器元件[120、122、124、126]。至少一个非易失性存储单元[110、112、114、116]和每个处理器元件[120、122、124、126]相对应。每个处理器元件[120、122、124、126]从至少一个对应的非易失性存储单元[110、112、114、116]中存取数据。处理器元件[120、122、124、126]对数据进行处理。非易失性存储单元[110、112、114、116]可包括磁存储单元[200]。 | ||
| 搜索关键词： | 非易失性存储器 并行 处理器 | ||
【主权项】：
1.一种并行处理器，包括：多个非易失性存储单元[110、112、114、116]；多个处理器元件[120、122、124、126]，至少一个非易失性存储单元[110、112、114、116]和每个处理器元件[120、122、124、126]相对应，每个处理器元件[120、122、124、126]从至少一个对应的非易失性存储单元[110、112、114、116]中存取数据并对数据进行处理。
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