[发明专利]计算机系统之记忆装置有效
| 申请号： | 200410058845.2 | 申请日： | 2004-07-30 |
| 公开（公告）号： | CN1581092A | 公开（公告）日： | 2005-02-16 |
| 发明（设计）人： | M·佩纳 | 申请（专利权）人： | 因芬尼昂技术股份公司 |
| 主分类号： | G06F11/22 | 分类号： | G06F11/22;G11C29/00 |
| 代理公司： | 中国专利代理(香港)有限公司 | 代理人： | 吴立明;张志醒 |
| 地址： | 联邦德*** | 国省代码： | 德国;DE |
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| 摘要： | 本发明系关於一种在计算机系统的记忆装置(1)，其具拥有排列於记忆模组(2)的半导体元件(3)的至少一记忆模组(2)，其可并列操作及经由串列线路(6、13、14)额外彼此连接，该至少一记忆模组具接口汇流排(4)以基於模组特定基准驱动该半导体元件(3)，及具一种接口(7)，其可由记忆控制器(5)－指定至该记忆模组(2)－经由该接口汇流排(4)驱动及经由该串列线路(6、13、14)存取该半导体元件(3)，使，在正常操作期间，经由该接口(7)测试及调整该半导体元件(3)接近应用及基於特定芯片基准为可能。 | ||
| 搜索关键词： | 计算机系统 记忆 装置 | ||
【主权项】：
1.在计算机系统之记忆装置(1)，其具-至少一记忆模组(2)，其具排列於该记忆模组(2)的半导体元件(3)，其可并列操作及经由串列线路(6、13、14)额外彼此连接，-一种接口汇流排(4)以特定模组基础驱动该半导体元件(3)，及-一种接口(7)，其可由记忆控制器(5)-指定至该记忆模组(2)-经由接口汇流排(4)驱动及经由该串列线路(6、13、14)存取该半导体元件(3)，使，在正常操作期间，经由该接口(7)测试及调整该半导体元件(3)接近应用及基於特定芯片基准为可能。
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