[发明专利]硬件加速显示水平线段的装置及其方法有效
| 申请号： | 200410077288.9 | 申请日： | 2004-12-03 |
| 公开（公告）号： | CN1783203A | 公开（公告）日： | 2006-06-07 |
| 发明（设计）人： | 姚力;陈巍 | 申请（专利权）人： | 深圳迈瑞生物医疗电子股份有限公司 |
| 主分类号： | G09G5/00 | 分类号： | G09G5/00;G06F3/14 |
| 代理公司： | 深圳睿智专利事务所 | 代理人： | 陈鸿荫 |
| 地址： | 518057广东省深圳市南*** | 国省代码： | 广东;44 |
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| 摘要： | 一种硬件加速显示水平线段的装置和方法，包括CPU，显示终端，显存及显示驱动电路；还包括显存控制装置，根据所有对显存的读、写操作请求，产生相应的逻辑信号来控制所有对显存读、写操作的进行；FIFO缓存器，用以缓存CPU送往所述显存控制装置的控制字，及对所述显存写操作的起始地址、数据。所述装置将复杂人机界面图形分解为水平线段组合，CPU给出每个线段的起始位置、长度和颜色，由所述控制装置自动将其所有显示点的数据写入显存，从而减少显示任务所消耗的CPU资源，提高CPU的利用率。采用本发明的嵌入式系统，结构精练、设计简单、能加速显示水平线段，进而加速显示对话框等人机界面，系统效率较高。 | ||
| 搜索关键词： | 硬件加速 显示 水平 线段 装置 及其 方法 | ||
【主权项】：
1.一种硬件加速显示水平线段的装置，包括：CPU，是嵌入式系统的控制核心；显示终端；显存，用以存储显示数据，所述每个显示数据映射显示终端上的各相应显示点；显示驱动电路，产生用于从所述显存中读取显示数据的逻辑信号，并将显示数据送往显示终端显示；其特征在于，还包括显存控制装置，连接所述显示驱动电路和显存，接收所有对显存的读、写操作请求信号，产生相应的逻辑信号来响应所述请求信号和控制所述对显存读、写操作的进行；FIFO缓存器，输入端与CPU总线相连，当CPU发出对显存的写操作请求时，用以缓存CPU送往所述显存控制装置的控制字，及对所述显存写操作的起始地址、数据。
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