[发明专利]用于控制存储器系统的方法和设备有效

专利信息
申请号: 200410082178.1 申请日: 2004-12-31
公开(公告)号: CN1731372A 公开(公告)日: 2006-02-08
发明(设计)人: 畑井田诚;松井孝夫;伊藤大介;冈田诚之;石塚孝治 申请(专利权)人: 富士通株式会社
主分类号: G06F12/08 分类号: G06F12/08
代理公司: 北京三友知识产权代理有限公司 代理人: 李辉
地址: 日本神奈*** 国省代码: 日本;JP
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摘要: 用于控制存储器系统的方法和设备。高速缓冲状态保持单元存储在高速缓冲存储器的每一条目中存储的数据的地址信息,并将每一条目的状态保持为“强修正”、“弱修正”、“共享”和“无效”中的任何之一。一旦接收数据读请求,数据取程序选择单元根据地址信息和状态选择至少一个数据取程序。读数据传送单元从所读取的数据中选择最新的数据并将该最新的数据传送到发出数据读请求的处理器。高速缓冲状态更新单元在登记数据的地址信息时,根据数据读请求的类型来更新条目的状态。
搜索关键词: 用于 控制 存储器 系统 方法 设备
【主权项】:
1、一种存储器系统控制设备,控制高速缓冲存储器与主存储器之间的一致性,所述高速缓冲存储器被提供用于多处理器系统的多个处理器中的每一个处理器,所述存储器系统控制设备包括:高速缓冲状态保持单元,其存储在所述高速缓冲存储器的每一条目中存储的数据的地址信息,并将每一条目的利用状态保持为“强修正”、“弱修正”、“共享”和“无效”中的任何一种;数据取程序选择单元,一旦从所述多个处理器之一接收了数据读请求,则基于所述高速缓冲状态保持单元保持的地址信息和利用状态,选择至少一个数据取程序;读数据传送单元,从通过由数据取程序选择单元选择的取程序所读取的数据中选择最新数据,并将被选择的最新数据传送到发出所述数据读请求的处理器;和高速缓冲状态更新单元,当将数据的地址信息登记在与发出所述数据读请求的所述处理器对应的高速缓冲状态保持单元的条目之一中时,基于所述数据读请求的类型来更新所述条目的利用状态。
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