[发明专利]绝对差和电路无效
| 申请号： | 200410086991.6 | 申请日： | 2004-10-27 |
| 公开（公告）号： | CN1767594A | 公开（公告）日： | 2006-05-03 |
| 发明（设计）人： | 杨行健;陈晋明;袁论贤 | 申请（专利权）人： | 联咏科技股份有限公司 |
| 主分类号： | H04N5/14 | 分类号： | H04N5/14;H04N7/26 |
| 代理公司： | 北京中原华和知识产权代理有限责任公司 | 代理人： | 寿宁;张华辉 |
| 地址： | 中国*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 本发明是关于一种绝对差和电路，包括绝对差(absolute difference)电路、第一加法器、第一缓存器以及第一选择电路。绝对差电路接收第一数据PMi，j及第二数据PSi，j，并且输出绝对差数据ADi，j＝|PMi，j－PSi，j|。第一加法器接收并且加总绝对差数据以及第一累加数据，以及将加总结果输出为第一加总值。第一缓存器依第一预定时序接收并闩锁第一加总值后输出第一绝对差和(SAD，sum of absolute difference)数据。第一选择电路接收并选择第一绝对差和数据或“0”，并且将所选择数据输出为第一累加数据。 | ||
| 搜索关键词： | 绝对 电路 | ||
【主权项】：
1、一种绝对差和电路，其特征在于其包括：一绝对差(absolute difference)电路，用以接收一第一数据PMi，j以及一第二数据PSi，j，并且输出一绝对差数据ADi，j，其中PMi，j、PSi，j与ADi，j分别表示第i列(row)第j个该第一数据、该第二数据以及该绝对差数据，并且ADi，j＝|PMi，j-PSi，j|，其中i以及j皆为大于等于0的整数；一第一加法器，用以接收并且加总该绝对差数据以及一第一累加数据，以及将加总结果输出为一第一加总值；一第一缓存器，用以依一第一预定时序接收并闩锁该第一加总值后输出一第一绝对差和(sum of absolute difference)数据；以及一第一选择电路，用以接收并选择该第一绝对差和数据以及一零数据其中之一，并将所选择数据输出为该第一累加数据，其中该零数据的值为0。
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