[发明专利]用于动态触发器的具有信号电平移位功能的主锁存电路有效
| 申请号： | 200480018787.9 | 申请日： | 2004-09-03 |
| 公开（公告）号： | CN1816967A | 公开（公告）日： | 2006-08-09 |
| 发明（设计）人： | 约尔格·贝特霍尔德;格奥尔格·格奥尔格阿肯斯;斯蒂芬·亨茨勒;多丽丝·施米特－兰西德尔 | 申请（专利权）人： | 印芬龙科技股份有限公司 |
| 主分类号： | H03K3/037 | 分类号： | H03K3/037;H03K3/356 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 朱进桂 |
| 地址： | 德国*** | 国省代码： | 德国;DE |
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| 摘要： |
提供一种具有用于动态触发器(1)的信号电平移位功能的主锁存电路(10)，其由时钟脉冲信号(Clk)计时，其中主锁存电路(10)包括信号延迟电路(13)，其延迟并倒相时钟脉冲信号(Clk)，从而导致特定时间延迟(AT)；以及电路节点(14)，其中，在充电阶段，时钟脉冲信号(Clk)是逻辑低电平，电路节点被充电到工作电压(VB)，以及在估算阶段，如果时钟脉冲信号(Clk)和被延迟倒相的时钟脉冲信号(Clk |
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| 搜索关键词： | 用于 动态 触发器 具有 信号 电平 移位 功能 主锁存 电路 | ||
【主权项】：
1.一种用于触发器的具有信号电平移位功能的主锁存电路，其中触发器由时钟信号(Clk)计时，主锁存电路(10)具有：(a)信号延迟电路(13)，其延迟具有特定时间延迟(ΔT)的当前时钟信号(Clk)；以及(b)电路节点(14)，其中，在充电阶段，当前的时钟信号(Clk)是逻辑低电平，电路节点被充电到工作电压(VB)，以及在估算阶段，如果当前的时钟信号(Clk)和延迟时钟信号(ClkDELAY)都是逻辑高电平时，电路节点能够根据当前的数据信号(D)放电，(c)电路节点(14)通过至少一个电容器(15)连接到参考电位。
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