[发明专利]用于提高可靠性的半导体器件封装无效
| 申请号： | 200480020214.X | 申请日： | 2004-07-12 |
| 公开（公告）号： | CN1823561A | 公开（公告）日： | 2006-08-23 |
| 发明（设计）人： | 珍妮特·帕特森 | 申请（专利权）人： | 麦斯韦尔技术股份有限公司 |
| 主分类号： | H05K9/00 | 分类号： | H05K9/00 |
| 代理公司： | 北京集佳知识产权代理有限公司 | 代理人： | 顾晋伟;刘继富 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 辐射屏蔽集成电路器件，包括多个封装层(804、806)、与所述多个封装层结合的辐射屏蔽盖(802)或基底(808)，其中电路芯片(816、818)被屏蔽以免接收超出所述电路芯片的总耐受剂量的辐射量。 | ||
| 搜索关键词： | 用于 提高 可靠性 半导体器件 封装 | ||
【主权项】：
1.辐射屏蔽集成电路器件，包括：多个封装层，所述多个封装层包括：电路封装；与所述电路封装结合的辐射屏蔽基底；和与所述辐射屏蔽基底结合的电路芯片；和与所述多个封装层结合的辐射屏蔽盖；其中所述电路芯片被屏蔽免于接收超出所述电路芯片总耐受剂量的辐射量；其中所述多个封装层相互依次堆叠，使得第一封装层的底部用作第二封装层的顶部。
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