[发明专利]双相脉冲调制解码器电路无效

专利信息
申请号: 200480029264.4 申请日: 2004-10-04
公开(公告)号: CN1864398A 公开(公告)日: 2006-11-15
发明(设计)人: D·S·科恩;D·J·迈耶 申请(专利权)人: 爱特梅尔股份有限公司
主分类号: H04M5/06 分类号: H04M5/06
代理公司: 上海专利商标事务所有限公司 代理人: 钱慰民
地址: 美国加利*** 国省代码: 美国;US
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摘要: 一种处理DPPM信号(43)的双相脉冲调制(DPPM)解码器电路(图4),该信号具有一系列高和低脉冲(图2B),其脉宽表示连续的M个数据位组以恢复由信号携带的数据。M比特组的2M个可能的数据值的每一个对应于2M个不同脉宽中的一个。电路块通过发送DPPM信号通过短延迟链(49,50)以及使用延迟输出(T3,……T10)同步触发寄存器(51A-D,52A-D)以采样未延迟信号(55,56)来确定每一脉冲的宽度。逻辑门电路(59-60,63-66)解释寄存输出(57A-D,58A-D)以获取对应的M比特组(73,74)。解码器电路具有两个基本相同的脉宽确定块(奇数和偶数编号元件),一个接收DPPM信号以测量高脉冲,另一个接收翻转的DPPM信号以测量低脉冲。
搜索关键词: 脉冲调制 解码器 电路
【主权项】:
1.一种双相脉冲调制(DPPM)解码器电路,包括:被配置成接收由一系列与数据比特的M比特组相对应的特定宽度的交替高低信号脉冲所组成的DPPPM信号的DPPM信号输入;耦合到所述DPPM信号输入的信号变换器;耦合到所述DPPM信号输入的高和低脉宽确定电路块,所述低脉宽确定电路块通过所述信号变换器耦合到所述DPPM信号输入,每个脉宽确定电路被构建为输出与各个高低信号脉冲的脉冲宽度相对应的M比特数据值;耦合到所述高和低脉宽确定电路块的并行输出寄存器,所述并行输出寄存器被配置成接收并交织所述M比特数据值,并且输出对应于所述DPPM信号的数据字。
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