[发明专利]延迟锁定回路及其锁定方法有效
| 申请号： | 200510073043.3 | 申请日： | 2005-05-30 |
| 公开（公告）号： | CN1767055A | 公开（公告）日： | 2006-05-03 |
| 发明（设计）人： | 李铉雨 | 申请（专利权）人： | 海力士半导体有限公司 |
| 主分类号： | G11C11/4063 | 分类号： | G11C11/4063;G11C7/22;H03L7/08 |
| 代理公司： | 北京集佳知识产权代理有限公司 | 代理人： | 王学强 |
| 地址： | 韩国*** | 国省代码： | 韩国;KR |
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| 摘要： | 本发明提供一种用以防止卡住故障的半导体存储装置的延迟锁定回路。本发明的DDL包括：缓冲器，用于输出与外部时钟的同相位相对应的第一时钟，并输出与外部时钟的异相位相对应的第二时钟；相位比较器，用于在比较第一时钟与反馈时钟的相位之后，输出控制信号以增加/减少延迟量；移位寄存器，用以依据该控制信号来输出移位信号；多任务单元，用于通过利用相位比较器的输出与移位寄存器的输出来选择第一和第二时钟中的一个。 | ||
| 搜索关键词： | 延迟 锁定 回路 及其 方法 | ||
【主权项】：
1.一种具有至少一个延迟线的延迟锁定回路，包括：缓冲装置，用于输出与外部时钟的同相位相对应的第一时钟，并输出与该外部时钟的不同相位相对应的第二时钟；相位比较器，用于在比较第一时钟与反馈时钟的相位之后，输出控制信号以增加/减少延迟量；移位寄存器，用于依据该控制信号来输出移位信号；多任务装置，用于通过利用该相位比较器的输出和该移位寄存器的输出来选择第一和第二时钟中的一个。
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