[发明专利]输入保护电路无效
| 申请号： | 200510084069.8 | 申请日： | 2005-07-12 |
| 公开（公告）号： | CN1835401A | 公开（公告）日： | 2006-09-20 |
| 发明（设计）人： | 酒林聪太 | 申请（专利权）人： | 富士通株式会社 |
| 主分类号： | H03K19/003 | 分类号： | H03K19/003;H01L27/04 |
| 代理公司： | 北京三友知识产权代理有限公司 | 代理人： | 李辉 |
| 地址： | 日本神*** | 国省代码： | 日本;JP |
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| 摘要： | 输入保护电路。提供了一种能够控制上拉/下拉的有效/无效，而不会使特性劣化的输入保护电路，该输入保护电路包括连接在外部输入端和与内部电路相连的缓冲电路之间的输入保护电阻；一端与电源相连、另一端与位于外部输入端和输入保护电阻之间的一点相连的p型MOS晶体管；以及输入保护电阻。 | ||
| 搜索关键词： | 输入 保护 电路 | ||
【主权项】：
1.一种输入保护电路，包括：第一输入保护单元，其连接在外部输入/输出端和内部电路之间，并且保护内部电路免于输入到外部输入/输出端的过电压的损害；以及上拉单元，其连接在预定的电压电源和位于所述外部输入/输出端和该第一输入保护单元之间的一点之间，当该外部输入/输出端开路时保持预定的电压，其还具有切换上拉单元的有效/无效的切换单元。
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