[发明专利]寄存器电路以及包括寄存器电路的同步集成电路有效
| 申请号： | 200510093694.9 | 申请日： | 2005-09-01 |
| 公开（公告）号： | CN1770329A | 公开（公告）日： | 2006-05-10 |
| 发明（设计）人： | 礒野贵亘 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G11C19/28 | 分类号： | G11C19/28;G11C7/00;H01L27/04;G06F12/00 |
| 代理公司： | 北京律诚同业知识产权代理有限公司 | 代理人： | 徐金国;梁挥 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供了与采用门控单元的传统时钟门控相比可以减少寄存器之间传送控制信号en的路径的延迟的寄存器电路。当输入到寄存器(1)中的控制信号en从激活态转换到非激活态时，通路控制电路(101f)禁止输入到通路控制电路(101f)的数据信号Q通过进入保持电路(101g)，与时钟信号clk的状态无关。当输入到寄存器(1)中的控制信号en从激活态向非激活态转变时，保持电路(101g)锁存通过通路控制电路(101f)的数据信号Q，与时钟信号clk的状态无关。这使得形成不采用门控单元的时钟门控，通过这样可以减少由门控单元产生的延迟时间。 | ||
| 搜索关键词： | 寄存器 电路 以及 包括 同步 集成电路 | ||
【主权项】：
1、一种包括通路控制电路和保持电路的寄存器，其中所述通路控制电路包括具有输入有时钟信号的栅极的第一晶体管、具有输入有数据信号的栅极的第二晶体管，以及具有输入有控制信号的栅极的第三晶体管，所述第一晶体管的源漏路径、所述第二晶体管的源漏路径和所述第三晶体管的源漏路径串联连接，当所述控制信号为激活态和非激活态其中之一的第一态时，所述通路控制电路根据所述时钟信号的状态使能通数据信号通路为保持电路，并且在所述控制信号为不同于第一态的第二态时，所述通路控制电路禁止数据信号通路为保持电路，并且所述保持电路锁存由所述通路控制电路传输的数据信号。
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