[发明专利]FPGA逻辑单元的功能模型和通用性逻辑单元装箱算法无效
| 申请号： | 200510111269.8 | 申请日： | 2005-12-08 |
| 公开（公告）号： | CN1786968A | 公开（公告）日： | 2006-06-14 |
| 发明（设计）人： | 童家榕;倪刚;来金梅 | 申请（专利权）人： | 复旦大学 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 上海正旦专利代理有限公司 | 代理人： | 陆飞;盛志范 |
| 地址： | 20043*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明属于电子设计自动化技术领域，具体为一种FPGA逻辑单元的功能模型及通用性逻辑单元装箱算法。该模型首先提取出FPGA逻辑单元中的功能元件，然后用功能元件和开关多路选择器的连接描述整个逻辑单元的结构，接着通过对逻辑单元进行不同的配置，生成许多仅由功能元件连接而成的有效功能电路，该模型能广泛地描述现有FPGA的逻辑单元的结构，并可由逻辑单元对应的有效功能电路得到逻辑单元的所有逻辑功能。基于此FPGA逻辑单元的功能模型，提出了通用性逻辑单元装箱算法FDUPack。FDUPack算法的核心思想是在用户电路中对每个有效功能电路反复进行电路图的模式匹配，是处理各种逻辑单元装箱问题的一种普适性算法。 | ||
| 搜索关键词： | fpga 逻辑 单元 功能 模型 通用性 装箱 算法 | ||
【主权项】：
1、一种FPGA逻辑单元的功能模型的建立方法，其特征在于具体步骤如下：(一)提取逻辑单元中的功能元件逻辑单元的功能元件有两类：1)开关多路选通器：逻辑单元内部由编程点控制的，起开关作用的多路选通器；2)功能元件：在逻辑单元内部典型的、有特定的逻辑功能的电路元件；(二)用功能元件和开关多路选通器的连接描述逻辑单元的结构；(三)通过对逻辑单元的不同配置，生成仅由功能元件连接而成的有效功能电路；(四)用功能电路描述逻辑单元的逻辑功能，从逻辑单元的一个结构，得到它的多个有效功能电路，这些功能电路描述了逻辑单元的多种功能；这里FPGA为现场可编程门阵列。
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