[发明专利]一种变换地址原址返回的级间流水FFT处理模块无效
| 申请号： | 200510111493.7 | 申请日： | 2005-12-14 |
| 公开（公告）号： | CN1983246A | 公开（公告）日： | 2007-06-20 |
| 发明（设计）人： | 任前义;梁继业;刘会杰 | 申请（专利权）人： | 上海微小卫星工程中心 |
| 主分类号： | G06F17/14 | 分类号： | G06F17/14 |
| 代理公司： | 上海天翔知识产权代理有限公司 | 代理人： | 陈学雯 |
| 地址： | 20005*** | 国省代码： | 上海;31 |
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| 摘要： | 一种变换地址原址返回的级间流水FFT处理模块，包括输入RAM模块、输入选择器、数据缓存模块、基4运算单元模块、输出选择器、输出RAM模块，输入、输出以及数据缓存模块3都采用4路并行的DPRAM，每一路DPRAM分别表示基4蝶形运算单元模块4中的A，B，C，D四路数据，其它模块中都不包含存储器资源。数据地址产生器和蝶形因子地址产生器分别与数据缓存模块和基4运算单元模块连接，其还包括一DPRAM连接输入选择器和输出选择器的数据转换模块，本发明通过巧妙有规律地改变每级运算数据的读取地址，运算结果原址返回，使得不包括输入输出就只占用一个存贮单元。这样在进行高速FFT运算的同时，大幅度的减少设计占用的硬件资源，以较少的资源达到接近级联流水的处理速度。 | ||
| 搜索关键词： | 一种 变换 地址 原址 返回 流水 fft 处理 模块 | ||
【主权项】：
1、一种变换地址原址返回的级间流水FFT处理模块，包括输入RAM模块、输入选择器、数据缓存模块、基4运算单元模块、输出选择器、输出RAM模块以及数据地址产生器和蝶形因子地址产生器，输入RAM模块、输入选择器、数据缓存模块、基4运算单元模块、输出选择器依次并行的四路并行的DPRAM连接，输出选择器与输出RAM模块之间通过两路并行的DPRAM连接，数据地址产生器和蝶形因子地址产生器分别与数据缓存模块和基4运算单元模块连接，其特征在于：还包括一数据转换模块，所述数据转换模块通过一路DPRAM连接输入选择器和输出选择器。
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