[发明专利]基于锁存器的串行端口输出缓冲器无效
| 申请号： | 200580038610.X | 申请日： | 2005-09-14 |
| 公开（公告）号： | CN101057206A | 公开（公告）日： | 2007-10-17 |
| 发明（设计）人： | 威廉·M·文森特 | 申请（专利权）人： | 德州仪器公司 |
| 主分类号： | G06F3/00 | 分类号： | G06F3/00;H03K19/0175;G06F13/12 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 | 代理人： | 王允方;刘国伟 |
| 地址： | 美国得*** | 国省代码： | 美国;US |
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| 摘要： | 本发明揭示一种具有使存取时间得到改进的串行接口的集成电路。所述串行接口包括布置成由触发器级(321至32n)及最末输出锁存器级(320)构成的移位寄存器形式的串行输出端口。所述最末输出锁存器级(320)包括一体式输出缓冲器(33)，且因此其构造不同于包括主锁存器及从属锁存器的其他输出触发器(321至32n)。因此，不需要外部输出缓冲器；所述最末输出锁存器级(320)直接驱动输出端子及外部串行数据线(SDATA)。 | ||
| 搜索关键词： | 基于 锁存器 串行 端口 输出 缓冲器 | ||
【主权项】：
1、一种包括串行输出端口的设备，其包括：多个触发器级，其彼此并联连接，并由串行时钟信号进行时钟控制；最末输出锁存器级，其具有连接至所述多个触发器级中最末一个的输出的输入，且包括：具有输入及输出的锁存器，其用于响应于所述串行时钟信号来锁存所存储状态；及输出缓冲器，其具有连接至所述锁存器的输出的输入，并具有连接至所述串行输出端口的外部端子的输出。
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